參數(shù)資料
型號(hào): DJIXPLCD0QE001
廠商: Intel Corp.
英文描述: Advanced 8-Port 10/100 Mbps PHY Transceivers
中文描述: 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器
文件頁數(shù): 130/226頁
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代理商: DJIXPLCD0QE001
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
132
Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
4.7
Serial MII Operation
The LXT9785/LXT9785E exchanges transmit and receive data with the controller via the Serial
MII (SMII). The SMII performs the following functions:
Conveys complete MII information between a 10/100 PHY and MAC with two pins per port.
Allows a multi-port MAC/PHY communication with one system clock.
Operates in both half and full-duplex.
Supports per-packet switching between 10 Mbps and 100 Mbps data rates.
The Serial MII operates at 125 MHz using a global reference clock and frame synchronization
signal (REFCLK and SYNC). Each port has an individual two-line data interface (TxData
n
and
RxData
n
). All signals are synchronous to REFCLK.
Table 43
summarizes the SMII signals.
Data is exchanged in 10-bit serial words. Each word contains one data byte (two nibbles of 4B
coded data) and two status bits. When the port is operating at 100 Mbps, each word contains a new
data byte. When the port is operating at 10 Mbps, each data byte is repeated 10 times.
Table 43. Intel
LXT9785/LXT9785E SMII Signal Summary
Signal
To
From
Purpose
TxData
PHY
MAC
Transmit data & control
SYNC
PHY
MAC
Synchronization
RxData
MAC
PHY
Receive data & control
REFCLK
MAC &
PHY
System
Synchronization
1. Refer to
Table 7, “Intel LXT9785/LXT9785E SMII Specific
Signal Descriptions – PQFP” on page 39
for detailed signal
descriptions.
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PDF描述
DJIXPLCD0SE000 Advanced 8-Port 10/100 Mbps PHY Transceivers
DJIXPLCD0SE001 Advanced 8-Port 10/100 Mbps PHY Transceivers
DJIXPLED0QE000 Advanced 8-Port 10/100 Mbps PHY Transceivers
DJIXPLED0QE001 Advanced 8-Port 10/100 Mbps PHY Transceivers
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