- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄376723 > DJIXPLED0QE001 (Intel Corp.) Advanced 8-Port 10/100 Mbps PHY Transceivers PDF資料下載
參數(shù)資料
| 型號： | DJIXPLED0QE001 |
| 廠商： | Intel Corp. |
| 英文描述： | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| 中文描述： | 先進的8端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁數(shù)： | 202/226頁 |
| 文件大?。?/td> | 1575K |
| 代理商： | DJIXPLED0QE001 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁當前第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁
LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
204
Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
Table 87. Auto-Negotiation Advertisement Register (Address 4)
Bit
Name
Description
Type
1
Default
15
Next Page
0 = Port has no ability to send manual next pages
1 = Port has ability to send manual next pages
Note:
This bit should only be set to manually control the auto-
negotiation process. It is not needed and should be cleared
for DTE Discovery.
R/W
0
14
Reserved
Write as 0, ignore on Read
R
0
13
6
Remote Fault
0 = No remote fault
1 = Remote fault
R/W
0
12
Reserved
Write as 0, ignore on Read
R/W
0
11
Asymmetric
Pause
Pause operation defined in Clause 40 and 27
0 = Port is not Pause capable
1 = Port can only send Pause
R/W
0
10
Pause
5
0 = Pause operation disabled
1 = Port can send and receive Pause
NOTE:
Default for the BGA15 package is 0.
R/W
LSHR
2,3
9
100BASE-T4
0 = 100BASE-T4 capability is not available
1 = 100BASE-T4 capability is available
(The LXT9785/LXT9785E does not support 100BASE-T4 but
allows this bit to be set to advertise in the auto-negotiation
sequence for 100BASE-T4 operation. An external
100BASE-T4 transceiver could be switched in if this
capability is desired.)
R/W
0
8
100BASE-TX
Full-Duplex
0 = Port is not 100BASE-TX full-duplex capable.
1 = Port is 100BASE-TX full-duplex capable
R/W
LSHR
2,4
7
100BASE-TX
Half-Duplex
0 = Port is not 100BASE-TX half-duplex capable
1 = Port is 100BASE-TX half-duplex capable
R/W
LSHR
2,4
6
10BASE-T
Full-Duplex
0 = Port is not 10BASE-T full-duplex capable
1 = Port is 10BASE-T full-duplex capable
R/W
LSHR
2,4
5
10BASE-T
Half-Duplex
0 = Port is not 10BASE-T half-duplex capable
1 = Port is 10BASE-T half-duplex capable
R/W
LSHR
2,4
4:0
Selector
Field,
S<4:0>
<00001> = IEEE 802.3
<00010> = IEEE 802.9 ISLAN-16T
<00000> = Reserved for future auto-negotiation development
<11111> = Reserved for future auto-negotiation development
Unspecified or reserved combinations should not be
transmitted
R/W
00001
1. R/W = Read/Write, R = Read Only
2. LSHR = Default value is derived from a single device input pin state or a group of device input pin states as
the pin(s) are latched at startup or hardware reset.
3. The default setting of Register bit 4.10 is determined by the PAUSE pin. The BGA15 package does not
have a Pause hardware configuration pin and has a default of 0.
4. Default settings for bits 4.5:8 are determined by CFG pins as described in
Table 42, “Intel LXT9785/
9785E Global Hardware Configuration Settings” on page 129
.
5. Pause operation is only valid for full-duplex modes.
6. If Register bit 4.13 is set to advertise a fault, Register bit 1.4 will be set.
NOTE:
Restart the auto-negotiation process whenever Register 4 is written/modified.
相關PDF資料 |
PDF描述 |
|---|---|
| DJIXPLED0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPLED0SE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0QE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DJIXPLED0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPLED0SE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPPAD0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
發(fā)布緊急采購，3分鐘左右您將得到回復。