參數(shù)資料
型號(hào)： DM74AS646WM
廠(chǎng)商： FAIRCHILD SEMICONDUCTOR CORP
元件分類(lèi)： 通用總線(xiàn)功能
英文描述： Octal Bus Transceiver and Register
中文描述： AS SERIES, 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO24
封裝： 0.300 INCH, MS-013, SOIC-24
文件頁(yè)數(shù)： 6/8頁(yè)
文件大?。?/td> 82K
代理商： DM74AS646WM
www.fairchildsemi.com
6
D
DM74AS648 Switching Characteristics
Note 7:
These parameters are measured with the internal output state of the storage register opposite to that of the bus input.
Symbol
Parameter
Conditions
From
(Input)
To
Min
Max
Units
(Output)
f
MAX
t
PLH
Maximum Clock Frequency
V
CC
=
4.5V to 5.5V,
R
1
=
R
2
=
500
C
L
=
50 pF
90
MHz
Propagation Delay Time
LOW-to-HIGH Level Output
Propagation Delay Time
2
8.5
ns
CAB or CBA
A or B
t
PHL
2
9
ns
HIGH-to-LOW Level Output
Propagation Delay Time
LOW-to-HIGH Level Output
t
PLH
2
8
ns
A or B
B or A
t
PHL
Propagation Delay Time
HIGH-to-LOW Level Output
Propagation Delay Time
1
7
ns
t
PLH
2
11
ns
LOW-to-HIGH Level Output
Propagation Delay Time
HIGH-to-LOW Level Output
SBA or SAB
A or B
t
PHL
2
9
ns
(Note 7)
t
PZH
Output Enable Time
to HIGH Level Output
Output Enable Time
2
9
ns
t
PZL
3
15
ns
to LOW Level Output
Output Disable Time
from HIGH Level Output
Enable G
A or B
t
PHZ
2
9
ns
t
PLZ
Output Disable Time
from LOW Level Output
Output Enable Time
2
9
ns
t
PZH
3
16
ns
to HIGH Level Output
Output Enable Time
to LOW Level Output
t
PZL
3
18
ns
DIR
A or B
t
PHZ
Output Disable Time
from HIGH Level Output
2
10
ns
t
PLZ
Output Disable Time
from LOW Level Output
2
10
ns
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PDF描述
DM74AS648NT 9-Bit Bus Transceiver With 3-State Outputs 24-SSOP -40 to 85
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DM74AS651 Octal Bus Transceiver and Register
DM74AS651NT 9-Bit Bus Transceiver With 3-State Outputs 24-TVSOP -40 to 85
DM74AS651WM 9-Bit Bus Transceiver With 3-State Outputs 24-TVSOP -40 to 85
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參數(shù)描述
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