參數(shù)資料
型號(hào)： DS21FT40
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA300
封裝： BGA-300
文件頁(yè)數(shù)： 65/87頁(yè)
文件大?。?/td> 386K
代理商： DS21FT40
DS21FT40
68 of 87
RECEIVE SIDE 1.544 MHz BOUNDARY TIMING (with elastic store enabled)
Figure 16-3
RSER
LSB MSB
F
MSB
LSB
RSYNC
RSYSCLK
RSYNC
1
2
3
CHANNEL 23/31
CHANNEL 24/32
CHANNEL 1/2
Notes:
1. Data from the E1 channels 1, 5, 9, 13, 17, 21, 25, and 29 is dropped (channel 2 from the E1 link is
mapped to channel 1 of the T1 link, etc.) and the F-bit position is added (forced to one)
2. RSYNC is in the output mode (RCR1.5 = 0)
3. RSYNC is in the input mode (RCR1.5 = 1)
RECEIVE SIDE 2.048 MHz BOUNDARY TIMING (with elastic store enabled)
Figure 16-4
RSER
LSB
MSB
LSB
CHANNEL 1
RSYNC
RSYSCLK
RSYNC
CHANNEL 31
CHANNEL 32
1
2
MSB
Notes:
1. RSYNC is in the output mode (RCR1.5 = 0)
2. RSYNC is in the input mode (RCR1.5 = 1)
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