參數(shù)資料
型號： DS21Q55
廠商： Maxim Integrated Products
文件頁數(shù)： 127/237頁
文件大小： 0K
描述： IC TXRX QUAD T1/E1/J1 SCT 256BGA
標準包裝： 40
功能： 收發(fā)器
接口： E1，J1，T1
電路數(shù)： 4
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 75mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 256-BBGA
供應(yīng)商設(shè)備封裝： 256-BGA（27x27）
包裝： 托盤
包括： BERT 發(fā)生器和檢測器，雙路 HDLC 控制器
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DS21Q55 Quad T1/E1/J1 Transceiver
212 of 237
31.2 E1 Mode
Figure 31-11. Receive-Side Timing
Note 1: RSYNC in frame mode (IOCR1.5 = 0).
Note 2: RSYNC in multiframe mode (IOCR1.5 = 1).
Note 3: RLCLK is programmed to output just the Sa bits.
Note 4: RLINK always outputs all five Sa bits as well as the rest of the receive data stream.
Note 5: This diagram assumes the CAS MF begins in the RAF frame.
Figure 31-12. Receive-Side Boundary Timing (with Elastic Store Disabled)
Note 1: RCHBLK is programmed to block channel 1.
Note 2: RLCLK is programmed to mark the Sa4 bit in RLINK.
Note 3: Shown is a RNAF frame boundary.
Note 4: RSIG normally contains the CAS multiframe alignment nibble (0000) in channel 1.
CHANNEL 32
CHANNEL 1
CHANNEL 2
CHANNEL 32
CHANNEL 1
CHANNEL 2
RCLK
RSER
RSYNC
RFSYNC
RSIG
RCHCLK
RCHBLK
1
RLCLK
RLINK
2
CD
A
LSB
MSB
AB
Si
1
A Sa4 Sa5 Sa6 Sa7 Sa8
Sa4 Sa5 Sa6 Sa7 Sa8
B
Note 4
FRAME#
1
2
3456
789
10
11
12 13
14
15
16
1
4
RLINK
RLCLK
3
RSYNC
1
RSYNC
RFSYNC
2
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PDF描述
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