參數(shù)資料
型號： DS26303LN-120+
廠商： Maxim Integrated Products
文件頁數(shù)： 43/101頁
文件大?。?/td> 0K
描述： IC LIU E1/T1/J1 3.3V 144-ELQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 13
類型： 線路接口裝置（LIU）
驅(qū)動器/接收器數(shù)： 8/8
規(guī)程： T1/E1/J1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 144-LQFP 裸露焊盤
包裝： 托盤
產(chǎn)品目錄頁面： 1430 (CN2011-ZH PDF)
DS26303: 3.3V, T1/E1/J1, Short-Haul, Octal Line Interface Unit
46 of 101
Register Name:
RDULR
Register Description:
RCLK Disable Upon LOS Register
Register Address:
16h
Bit #
7
6
5
4
3
2
1
0
Name
RDULR8
RDULR7
RDULR6
RDULR5
RDULR4
RDULR3
RDULR2
RDULR1
Default
0
Bits 7 to 0: RCLK Disable Upon LOS Register n (RDULRn).
When this bit is set the RCLKn is disabled upon a
loss of signal and set as a low output. When reset, RCLKn switches to MCLK within 10ms of a loss of signal.
Register Name:
GISC
Register Description:
Global Interrupt Status Control Register
Register Address:
1Eh
Bit #
7
6
5
4
3
2
1
0
Name
—
INTM
CWE
Default
0
Bit 1: INT Pin Mode (INTM).
This bit determines the inactive mode of the
INTB pin. The INTB pin always drives low
when active.
0 = Pin is high impedance when not active.
1 = Pin drives high when not active.
Bit 0: Clear-On-Write Enable (CWE).
When this bit is set, clear-on-write is enabled for all the latched interrupt
status registers. The host processor must write a 1 to the latched interrupt status register bit position before the
particular bit is cleared.
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參數(shù)描述
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