參數(shù)資料
型號： DS26519GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 135/310頁
文件大小： 0K
描述： IC TXRX T1/E1/J1 16PRT 484-HSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 30
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 16/16
規(guī)程： 以太網(wǎng)
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 484-HSBGA（23x23）
包裝： 管件
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DS26519 16-Port T1/E1/J1 Transceiver
22 of 310
NAME
PIN
TYPE
FUNCTION
TRANSMIT FRAMER
TSER1
B15
TSER2
D14
TSER3
T8
TSER4
R12
TSER5
T10
TSER6
U11
TSER7
C17
TSER8
E17
TSER9
U21
TSER10
R20
TSER11
W6
TSER12
C1
TSER13
E1
TSER14
H1
TSER15
H15
TSER16
F17
Input
Transmit NRZ Serial Data.
These pins are sampled on the falling edge of
TCLKn when the transmit-side elastic store is disabled. These pins are sampled
on the falling edge of TSYSCLKn when the transmit-side elastic store is enabled.
In IBO mode, data for multiple framers can be used in high-speed multiplexed
scheme. This is described in Section 9.8.2. The table there presents the
combination of framer data for each of the streams.
TSYSCLKn is used as a reference when IBO is invoked. See Table 9-8.
TCLK1
F7
TCLK2
G10
TCLK3
R8
TCLK4
AB4
TCLK5
AB6
TCLK6
AB8
TCLK7
B21
TCLK8
D18
TCLK9
K14
TCLK10
P16
TCLK11
W5
TCLK12
M18
TCLK13
N8
TCLK14
N7
TCLK15
P21
TCLK16
D17
Input
Transmit Clock 1 to 16.
A 1.544MHz or a 2.048MHz primary clock. Used to
clock data through the transmit side of the transceiver. TSERn data is sampled
on the falling edge of TCLKn. TCLKn is used to sample TSERn when the elastic
store is not enabled or IBO is not used. When the elastic store is enabled, TCLKn
is used as the internal transmit clock for the framer side or the elastic store
including the transmit framer and LIU. With the elastic store enabled, TCLKn can
be either synchronous or asynchronous to TSYSCLKn which either prevents or
allows for slips. In addition when IBO mode is enabled, TCLKn must be
synchronous to TSYSCLKn which prevents slips in the elastic store.
Note:
This clock must be provided for proper device operation. The only
exception is when the TCR3 register is configured to source TCLK internally from
RCLK.
TSYSCLK1
W11
TSYSCLK2
A16
TSYSCLK3
K8
TSYSCLK4
U7
TSYSCLK5
V10
TSYSCLK6
U14
TSYSCLK7
C18
TSYSCLK8
Y21
TSYSCLK9
L4
TSYSCLK10
R19
TSYSCLK11
E2
TSYSCLK12
AA3
TSYSCLK13
J1
TSYSCLK14
J2
TSYSCLK15
E16
TSYSCLK16
M17
Input
Transmit System Clock 1 to 16.
1.544MHz, 2.048MHz, 4.096MHz, 8.192MHz,
or 16.384MHz clock. Only used when the transmit-side elastic store function is
enabled. Should be tied low in applications that do not use the transmit-side
elastic store. The clock can be 4.096MHz, 8.912MHz, or 16.384MHz when IBO
mode is used.
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PDF描述
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DS26519GNA2+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 16-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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