參數資料
型號: DS26521LN+
廠商: Maxim Integrated Products
文件頁數: 115/258頁
文件大小: 0K
描述: IC TXRX T1/E1/J1 64-LQFP
產品培訓模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝: 160
類型: 線路接口裝置(LIU)
驅動器/接收器數: 1/1
規(guī)程: T1/E1/J1
電源電壓: 3.135 V ~ 3.465 V
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應商設備封裝: 64-LQFP(10x10)
包裝: 托盤
產品目錄頁面: 1430 (CN2011-ZH PDF)
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DS26521 Single T1/E1/J1 Transceiver
201 of 258
Register Name:
THSCS1, THSCS2, THSCS3, THSCS4
Register Description:
Transmit Hardware-Signaling Channel Select Registers 1 to 4
Register Address:
1C8h, 1C9h, 1CAh, 1CBh
Bit #
(MSB) 7
6
5
4
3
2
1
0 (LSB)
CH8
CH7
CH6
CH5
CH4
CH3
CH2
CH1
THSCS1
CH16
CH15
CH14
CH13
CH12
CH11
CH10
CH9
THSCS2
CH24
CH23
CH22
CH21
CH20
CH19
CH18
CH17
THSCS3
Name
CH32
CH31
CH30
CH29
CH28
CH27
CH26
CH25
THSCS4*
(E1 Mode
Only)
Default
0
Bits 7 to 0: Transmit Hardware-Signaling Channel Select for Channels 1 to 32 (CH[1:32]). These bits
determine which channels have signaling data inserted from the TSIG pin into the TSER PCM data.
0 = do not source signaling data from the TSIG pin for this channel
1 = source signaling data from the TSIG pin for this channel
*Note that THSCS4 is only used in 2.048MHz backplane applications.
Register Name:
TGCCS1, TGCCS2, TGCCS3, TGCCS4
Register Description:
Transmit Gapped-Clock Channel Select Registers 1 to 4
Register Address:
1CCh, 1CDh, 1CEh, 1CFh
Bit #
(MSB)
(LSB)
CH8
CH7
CH6
CH5
CH4
CH3
CH2
CH1
TGCCS1
CH16
CH15
CH14
CH13
CH12
CH11
CH10
CH9
TGCCS2
CH24
CH23
CH22
CH21
CH20
CH19
CH18
CH17
TGCCS3
Name
CH32
CH31
CH30
CH29
CH28
CH27
CH26
CH25
(F-bit)
TGCCS4*
(E1 Mode
Only)
Default
0
Bits 7 to 0: Transmit Gapped-Clock Channel Select Channels 1 to 32 (CH[1:32]).
0 = no clock is present on TCHCLK during this channel time
1 = force a clock on TCHCLK during this channel time. The clock will be synchronous with TCLK if the
elastic store is disabled, and synchronous with TSYSCLK if the elastic store is enabled.
*Note that TGCCS4 has two functions:
When 2.048MHz backplane mode is selected, this register allows the user to enable the gapped clock on
TCHCLK for any of the 32 possible backplane channels.
When 1.544MHz backplane mode is selected, the LSB of this register determines whether or not a clock is
generated on TCHCLK during the F-bit time:
TGCCS4.0 = 0: Do not generate a clock during the F-bit
TGCCS4.0 = 1: Generate a clock during the F-bit
In this mode, TGCCS4.1 to TGCCS4.7 should be set to 0.
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PDF描述
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DS26521N 制造商:Maxim Integrated Products 功能描述:DS26521 MONOLITHIC T1E1J1 SCT IND - Rail/Tube
DS26522 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Dual T1/E1/J1 Transceiver
DS26522DK 功能描述:網絡開發(fā)工具 DS26522 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 產品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數據速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
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