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參數(shù)資料
| 型號： | DS3173 |
| 英文描述： | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| 中文描述： | 單/雙/三/四路、DS3/E3單芯片收發(fā)器 |
| 文件頁數(shù)： | 60/232頁 |
| 文件大?。?/td> | 2133K |
| 代理商： | DS3173 |
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DS3171/DS3172/DS3173/DS3174
60 of 231
Figure 10-4. Example IO Pin Clock Muxing
Q
Q
SET
CLR
D
INTERNAL
SIGNAL
TCLKI
PIN INVERT
RLCLK
PIN INVERT
RX LIU CLK
DS3 CLK
E3 CLK
STS-1 CLK
CLAD CLOCKS
TCLKO
PIN INVERT
CLOCK TREE
TDEN
PIN INVERT
Q
Q
SET
CLR
D
DELAY
TFTS
0
1
TSER
PIN INVERT
Q
Q
SET
CLR
D
Q
Q
SET
CLR
D
INTERNAL
SIGNAL
DELAY
0
1
TFTS
Q
Q
SET
CLR
D
INTERNAL
SIGNAL
TLCLK
PIN INVERT
CLOCK TREE
TPOS
PIN INVERT
Q
Q
SET
CLR
D
DELAY
TLTS
0
1
Q
Q
SET
CLR
D
INTERNAL
SIGNAL
RCLKO
PIN INVERT
CLOCK TREE
RSER
PIN INVERT
Q
Q
SET
CLR
D
DELAY
RFTS
0
1
10.2.5 Gapped Clocks
The transmit and receive output clocks can be gapped in certain configurations. See
Table 10-22
and
Table 10-24
for the configuration settings. The gapped clocks are active during DS3 or E3 framed payload bits overhead bits
depending on which mode the device is configured for.
In the internal DS3 or E3 frame modes, the transmit gapped clock is created by the logical OR of the TCLKOn and
TDENn signals creating a positive or negative clock edge for each payload bit, the receive gapped clock is created
by the logical OR of the RCLKOn and RDENn signals.
When the output clock is disabled, the gapped output signal is high during clock periods if the pin is not inverted,
otherwise it will be low.
The gapped clocks are very useful when the data being clocked does not need to be aligned with any frame
structure. The data is simply clocked one bit at a time as a continuous data stream.
10.3 Reset and Power-Down
The device can be reset at a global level via the
GL.CR1.
RST bit or the
RST
pin and at the port level via the
PORT.CR1.
RST bit and each port can be explicitly powered down via the
PORT.CR1.
PD bit. The JTAG logic is
reset using the power on reset signal from one of the LIUs as well as from the
JTRST
pin.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3173N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3174 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3174N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS318PIN | Industrial Control IC |
| DS319 | Two-Way Power Divider 10500 MHz |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS3173N | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Triple DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3174 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3174+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3174DK | 功能描述:網(wǎng)絡(luò)開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V |
| DS3174N | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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