參數(shù)資料
型號： DS3181N+
廠商： Maxim Integrated Products
文件頁數(shù)： 7/400頁
文件大?。?/td> 0K
描述： IC ATM/PACKET PHY W/LIU 400PBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 散裝
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DS3181/DS3182/DS3183/DS3184
104
Table 10-7. Transmit Framer Pin Signal Timing Source Select
LOOPT
LBM[2:0]
LIUEN
CLADC
TFTS
VALID TIMING TO THESE
CLOCK PINS
1
XXX
X
0
TCLKOn, TLCLKn, RCLKOn
1
XXX
0
X
1
RLCLKn
1
XXX
1
X
1
No valid timing to any input
clock pin
0
PLB (011) or DLB (100) or
ALB (001)
0
X
0
TCLKOn, TLCLKn, RCLKOn
0
PLB (011) or DLB (100)
1
X
0
TCLKOn, TLCLKn, RCLKOn
0
DLB&LLB (110)
X
0
TCLKOn, RCLKOn
0
LLB (010)
X
0
TCLKOn
0
not LLB, DLB or PLB (00X)
X
0
TCLKOn, TLCLKn
0
not PLB (011)
X
0
1
No valid timing to any input
clock pin
0
not PLB (011)
X
1
TCLKIn
0
PLB (011)
0
X
1
RLCLKn
0
PLB (011)
1
X
1
No valid timing to any input
clock pin
10.2.3.3 Receive Line Interface Pin Timing Source Selection
(RPOSn/RDATn, RNEGn/RLCVn/ROHMIn)
The receive line interface signal pin group must clocked in with the RLCLK clock input pin. When the LIU is
enabled, the receive line interface pins are not used so there is no valid clock reference.
Table 10-8. Receive Line Interface Pin Signal Timing Source Select
LOOPT
LBM[2:0]
LIUEN
CLADC
VALID TIMING TO THESE
CLOCK PINS
X
XXX
0
X
RLCLKn
X
XXX
1
X
No valid timing to any clock pin
10.2.3.4 Receiver Framer and Fractional Pin Timing Source Selection
(RSERn, RSOFOn/RDENn/RFOHENOn, RFOHENIn/RPDENIn, RPDATn)
The receive framer and fractional signal pin group has the same functional timing clock source as the RCLKOn pin
described in Table 10-5.
Other clock pins can be used for the external timing. The RCLKOn receive clock output pin is always a valid output
clock for external logic to use for these signals when PORT.CR3.RFTS=0.
The receive framer and fractional timing select bit (RFTS) is used to select input or output clock pin timing. When
RFTS=0, output clock timing is selected. When RFTS=1, input clock timing is selected. If RFTS is set for input
clock timing and an output clock pin is used, or If RFTS is set for output clock timing and an input clock pin is used,
then the setup, hold and delay timings, as specified in Table 18-1, will not be valid. There are some combinations
of RFTS=1 and other modes in which there is no input clock pin available for external timing since the clock source
is derived internally from the RX LIU or the CLAD.
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PDF描述
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參數(shù)描述
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DS3182 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3182+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3182N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3183 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Trpl ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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