參數(shù)資料
型號： DS80C323-QCD
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 微控制器/微處理器
英文描述： High-Speed/Low-Power Microcontrollers
中文描述： 8-BIT, MROM, 18 MHz, MICROCONTROLLER, PQCC44
封裝： PLASTIC, LCC-44
文件頁數(shù)： 26/42頁
文件大?。?/td> 1501K
代理商： DS80C323-QCD
DS80C320/DS80C323
26 of 42
DS80C320 MOVX CHARACTERISTICS UP TO 33 MHz
PARAMETER
SYMBOL
VARIABLE
CLOCK
MIN
2t
CLCL
-11
t
MCS
-11
2t
CLCL
-11
t
MCS
-11
VARIABLE
CLOCK
MAX
UNITS
STRETCH
RD
Pulse Width
t
RLRH
ns
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
t
MCS
=0
t
MCS
>0
WR
Pulse Width
t
WLWH
ns
RD
Low to Valid Data In
t
RLDV
2t
CLCL
-25
t
MCS
-25
t
CLCL
-5
2t
CLCL
-5
2.5t
CLCL
-26
1.5t
CLCL
-28+t
MCS
3t
CLCL
-24
2t
CLCL
-31+t
MCS
3.5t
CLCL
-32
2.5t
CLCL
-34+t
MCS
0.5t
CLCL
+6
1.5t
CLCL
+8
ns
Data Hold After Read
Data Float After Read
t
RHDX
t
RHDZ
0
ns
ns
ALE Low to Valid
Data In
Port 0 Address to Valid
Data In
Port 2 Address to Valid
Data In
ALE Low to
RD
or
WR
Low
Port 0 Address Valid to
RD
or
WR
Low
Port 2 Address Valid to
RD
or
WR
Low
Data Valid to
WR
Transition
Data Hold After Write
t
LLDV
ns
t
AVDV1
ns
t
AVDV2
ns
t
LLWL
0.5t
CLCL
-5
1.5t
CLCL
-5
t
CLCL
-9
2t
CLCL
-10
1.5t
CLCL
-9
2.5t
CLCL
-13
-9
t
CLCL
-10
t
CLCL
-7
2t
CLCL
-5
0
t
CLCL
-5
ns
t
AVWL1
ns
t
AVWL2
ns
t
QVWX
ns
t
WHQX
ns
RD
Low to Address Float
RD
or
WR
High to
ALE High
NOTE:
t
MCS
is a time period related to the Stretch memory cycle selection. The following table shows the
value of t
MCS
for each Stretch selection.
M2
M1
M0
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
t
RLAZ
t
WHLH
note 5
10
t
CLCL
+11
ns
ns
MOVX CYCLES
2 machine cycles
3 machine cycles (default)
4 machine cycles
5 machine cycles
6 machine cycles
7 machine cycles
8 machine cycles
9 machine cycles
t
MCS
0
4 t
CLCL
8 t
CLCL
12 t
CLCL
16 t
CLCL
20 t
CLCL
24 t
CLCL
28 t
CLCL
相關(guān)PDF資料
PDF描述
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DS80C320MNG (434.89 k)
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