參數(shù)資料
型號(hào)： DSPB56367AG150
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 47/100頁(yè)
文件大小： 0K
描述： IC DSP 24BIT 150MHZ 144-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類(lèi)型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 150MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 95°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤(pán)
External Memory Expansion Port (Port A)
DSP56367 Technical Data, Rev. 2.1
3-26
Freescale Semiconductor
183
WR assertion to RAS deassertion
tRWL
15.75
× TC 4.3
153.2
—
ns
184
WR assertion to CAS deassertion
tCWL
14.25
× TC 4.3
138.2
—
ns
185
Data valid to CAS assertion (write)
tDS
8.75
× TC 4.0
83.5
—
ns
186
CAS assertion to data not valid (write)
tDH
6.25
× TC 4.0
58.5
—
ns
187
RAS assertion to data not valid (write)
tDHR
9.75
× TC 4.0
93.5
—
ns
188
WR assertion to CAS assertion
tWCS
9.5
× TC 4.3
90.7
—
ns
189
CAS assertion to RAS assertion (refresh)
tCSR
1.5
× TC 4.0
11.0
—
ns
190
RAS deassertion to CAS assertion (refresh)
tRPC
4.75
× TC 4.0
43.5
—
ns
191
RD assertion to RAS deassertion
tROH
15.5
× TC 4.0
151.0
—
ns
192
RD assertion to data valid
tGA
14
× TC 5.7
—
134.3
ns
193
RD deassertion to data not valid5
tGZ
0.0
—
ns
194
WR assertion to data active
0.75
× TC – 1.5
6.0
—
ns
195
WR deassertion to data high impedance
0.25
× TC
—2.5
ns
1 The number of wait states for an out-of-page access is specified in the DCR.
2 The refresh period is specified in the DCR.
3 An expression is used to compute the maximum or minimum value listed (or both if the expression includes ±).
4 Either t
RCH or tRRH must be satisfied for read cycles.
5 RD deassertion always occurs after CAS deassertion; therefore, the restricted timing is t
OFF and not tGZ.
Table 3-13 DRAM Out-of-Page and Refresh Timings, Fifteen Wait States1, 2 (continued)
No.
Characteristics
Symbol
Expression3
100 MHz
Unit
Min
Max
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DSPB56371AF180 制造商:Freescale Semiconductor 功能描述:Digital Signal Processor (DSP) IC
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