Symphony DSP56720/DSP56721 Multi-Core Audio Processors, Rev. 5 Freescale Semicon" />
參數(shù)資料
型號(hào)： DSPB56721AG
廠商： Freescale Semiconductor
文件頁數(shù)： 29/54頁
文件大?。?/td> 0K
描述： AUDIO PROCESSOR SYMPH 144-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 200MHz
非易失內(nèi)存： 外部
芯片上RAM： 744kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.00V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
Symphony DSP56720/DSP56721 Multi-Core Audio Processors, Rev. 5
Freescale Semiconductor
35
Figure 28. Test Access Port Timing Diagram
2.17
Watchdog Timer Timing
Table 14 lists the watchdog timer timing.
2.18
Host Data Interface (HDI24) Timing
The HDI24 module is only on the DSP56721 device; the DSP56720 device does not have a HDI24 module. Also, only 16 bits
of the HDI24 interface are pinned out on the DSP56721 device. Table 15 lists HDI24 timing and Figure 29 through Figure 35
show the timing diagrams.
Table 14. Watchdog Timer Timing Parameters
No.
Characteristics
Expression
Min
Max
Unit
120
Delay from time-out to fall of WDT, WDT_1
2
× Tc
10.0
—
ns
121
Delay from timer clear to rise of WDT, WDT_1
2
× Tc
10.0
—
ns
Table 15. HDI24 Timing Parameters
No.
Characteristics
2
Expression
200 MHz
Unit
Min
Max
317
Read data strobe assertion width
3
HACK read assertion width
TC + 9.9
14.9
—
ns
318
Read data strobe deassertion width
3
HACK read deassertion width
—9.9
—
ns
319
Read data strobe deassertion width
3
after “Last Data Register” reads
4,5
,
or between two consecutive CVR, ICR, or ISR reads
6
HACK deassertion width after “Last Data Register” reads
4,5
2
× TC + 6.6
16.6
—
ns
VIH
VIL
116
117
118
119
118
TCK
(Input)
TDI
TMS
(Input)
TDO
(Output)
TDO
(Output)
TDO
(Output)
Input Data Valid
Output Data Valid
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