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參數(shù)資料
| 型號(hào)： | EDD5108ABTA |
| 廠商： | Elpida Memory, Inc. |
| 英文描述： | 512M bits DDR SDRAM |
| 中文描述： | 512M比特DDR內(nèi)存 |
| 文件頁數(shù)： | 36/48頁 |
| 文件大?。?/td> | 558K |
| 代理商： | EDD5108ABTA |
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EDD5108AFTA-5, EDD5116AFTA-5
Data Sheet E0741E20 (Ver. 2.0)
36
A Write command to the consecutive Precharge command interval (same bank)
The minimum interval tWPD is necessary between the write command and the precharge command.
in0
in1
in2
in3
CK
/CK
DQ
DM
DQS
Command
t1
t0
t2
t3
t4
t5
t6
t7
Last data input
tWPD
WRIT
NOP
tWR
PRE/PALL
NOP
WRITE to PRECHARGE Command Interval (same bank) (BL = 4)
Precharge Termination in Write Cycles
During a burst write cycle without auto precharge, the burst write operation is terminated by a precharge command
of the same bank. In order to write the last input data, tWR (min) must be satisfied. When the precharge command
is issued, the invalid data must be masked by DM.
in2
in3
in0
in1
CK
/CK
DQ
DM
DQS
Command
t1
t0
t2
t3
t4
t5
t6
t7
Data masked
WRIT
NOP
NOP
tWR
PRE/PALL
Precharge Termination in Write Cycles (same bank) (BL = 4)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EDD5108ADTA-7B-E | 512M bits DDR SDRAM |
| EDD5108ADTA-7BL | DIAL SCALE 10 TURN CONCENTRIC |
| EDD5108ADTA-E | 512M bits DDR SDRAM |
| EDD5108ADTA-7AL-E | 512M bits DDR SDRAM |
| EDD5116AFTA-6B-E | 512M bits DDR SDRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EDD5108ABTA-6B | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108ABTA-7A | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108ABTA-7B | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108ADTA | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108ADTA-5C | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
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