- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄97875 > EDI2AG272128V12D1 2x128Kx72, 3.3V Sync/Sync Burst SRAM Module(2x128Kx72, 3.3V，12ns,同步/同步脈沖靜態(tài)RAM模塊) PDF資料下載
參數(shù)資料
| 型號(hào)： | EDI2AG272128V12D1 |
| 英文描述： | 2x128Kx72, 3.3V Sync/Sync Burst SRAM Module(2x128Kx72, 3.3V，12ns,同步/同步脈沖靜態(tài)RAM模塊) |
| 中文描述： | 2x128Kx72，3.3同步/同步突發(fā)靜態(tài)存儲(chǔ)器模塊（2x128Kx72，3.3伏，12ns，同步/同步脈沖靜態(tài)內(nèi)存模塊） |
| 文件頁(yè)數(shù)： | 10/11頁(yè) |
| 文件大小： | 264K |
| 代理商： | EDI2AG272128V12D1 |
EDI2AG272128V
8
White Electronic Designs Corporation (508) 366-5151 www.whiteedc.com
SYNCHRONOUS (NON-BURST) WRITE CYCLE
tGHKH
tGWLKH
tAVKH
tDVKH
Write Cycle
OE\
GW\
ADDR
CLK
CE\
Addr 1
Addr 2
tKLKH
tKHKH
tKHKL
Back to Back Writes
tKHGH
tKHDX
tKHGWH
tKHAX
DQ
Ex\
G\
WRITE CYCLE TIMING PARAMETERS
8.5ns
9ns
10ns
12ns
Description
Sym
Min
Max
Min
Max
Min
Max
Min
Max
Units
Clock Cycle Time
tKHKH
*
10
12
15
ns
Clock High Time
tKHKL
**
4
5
ns
Clock Low Time
tKLKH
**
4
5
ns
Address Setup
tAVKH
*
2.5
ns
Address Hold
tKHAX
*
1.0
ns
Bank Enable Setup
tEVKH
*
2.5
ns
Bank Enable Hold
tKHEX
*
1.0
ns
Global Write Enable Setup
tWVKH
*
2.5
ns
Global Write Enable Hold
tKHWX
*
1.0
ns
Data Setup
tDVKH
*
2.5
ns
Data Hold
tKHDX
*
1.0
ns
*TBD
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EDI2AG272128V85D1 | 2x128Kx72, 3.3V Sync/Sync Burst SRAM Module(2x128Kx72, 3.3V，8.5ns,同步/同步脈沖靜態(tài)RAM模塊) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EDI2AG272128V9D1 | 制造商:WEDC 制造商全稱:White Electronic Designs Corporation 功能描述:2 Megabyte Sync/Sync Burst, Small Outline DIMM |
| EDI2AG272128V-D1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SSRAM Modules |
| EDI2AG272129V | 制造商:WEDC 制造商全稱:White Electronic Designs Corporation 功能描述:2 Megabyte Sync/Sync Burst, Small Outline DIMM |
| EDI2AG272129V10D1 | 制造商:WEDC 制造商全稱:White Electronic Designs Corporation 功能描述:2 Megabyte Sync/Sync Burst, Small Outline DIMM |
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