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參數(shù)資料
| 型號： | EFM32TG108F8 |
| 廠商： | Energy Micro |
| 文件頁數(shù)： | 371/526頁 |
| 文件大小： | 0K |
| 描述： | MCU 32BIT 8KB FLASH 24-QFN |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | Tiny Gecko |
| 核心處理器： | ARM? Cortex?-M3 |
| 芯體尺寸： | 32-位 |
| 速度： | 32MHz |
| 連通性： | EBI/EMI，I²C，IrDA，智能卡，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 17 |
| 程序存儲(chǔ)器容量： | 8KB（8K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.8 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x12b，D/A 1x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 24-VQFN 裸露焊盤 |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | EFM32TG108F8-QFN24 |
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Preliminary
...the world's most energy friendly microcontrollers
2011-05-19 - d0034_Rev0.91
432
www.energymicro.com
the OPA output by setting corresponding bits in OUTPEN in DACn_OPAxMUX. For OPA0 alternative
output 4 is connected to ADC input mux CH0 when enabled. OPA1's alternative output 4 is connected
to ADC input mux CH1 when enabled. For OPA2, the two main outputs can be connected to ADC input
mux CH0 and ADC input mux CH5 respectively when enabled. In addition to these, OPA0 and OPA1
main outputs can also use the DAC0 ADC input and DAC1 ADC input. See Section 24.3.4 (p. 388) , in
the ADC chapter for information on how to configure the ADC input mux.
26.3.1.3 Gain Programming
The feedback path of each mux includes a resistor ladder, which can be used to select a set of gain
values. The gain can be selected by the RESSEL bitfield located in DACn_OPAxMUX register. The
gain values are taken from tappings of the resistor ladder based on ratio of R2/R1. It is also possible to
bypass the resistor ladder in Unity Gain (UG) mode.
26.3.1.4 Offset Calibration
The offset calibration registers are located in different registers for the opamps. OPA0 and OPA1's offset
can be set through the CH0OFFSET and CH1OFFSET bitfields respectively in DACn_CAL. The offset
for OPA2 can be set through OPA2OFFSET in DACn_OPAOFFSET.
26.3.1.5 Shorting Non-inverting and Inverting Input
Functionality for offset calibration of the opamps has been added, this functionality is enabled by setting
the OPAxSHORT bitfield in DACn_OPAxCTRL. Setting this bitfield enables a switch that shorts between
the inverting and non-inverting input of the OPA, effectively driving the offset voltage of the opamp to
the output. Using the ADC to measure this offset, the calibration register can be adjusted to minimize
the output offset.
26.3.1.6 Low Pass Filter
The low pass filter is located between the pad and the positive input. The lowpass filter is designed to
couple the input signal to local VSS for high frequencies and has a 3dB frequency of approximately
130MHz when driven from a 50 ohm source. The filter adds a parasitic capacitance of approximately
1.2pF towards local VSS when enabled. The filter is enabled out of reset and can be disabled by setting
OPAxLPFDIS in DACn_OPAxCTRL.
26.3.1.7 Disabling of rail-to-rail Operation
Each opamp can have the input rail-to-rail stage disabled by setting the OPAxHCMDIS bitfield in
DACn_OPACTRL. Disabling the rail-to-rail input stage improves linearity of the opamp, thus improving
the Total Harmonic Distortion, THD, at the cost of reduced input signal swing.
26.3.2 Opamp Modes
The opamp can be configured to perform different Operational Amplifier functions by configuring the
internal signal routing between the opamps. The modes available are described in the following sections.
26.3.2.1 General Opamp Mode
In this mode the resistor ladder is isolated from the feedback path and input signal routing is defined
by OPAxPOSSEL and OPAxNEGSEL in DACn_OPAxMUX. The output signal routing is defined by
OUTPEN in DACn_OPAxMUX
Table 26.1. General Opamp Mode Configuration
OPA bitfields
OPA Configuration
OPAx POSSEL
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