The Remote System Configuration with Stratix &a" />
參數(shù)資料
型號： EP1S10F672I7
廠商： Altera
文件頁數(shù)： 691/864頁
文件大?。?/td> 0K
描述： IC STRATIX FPGA 10K LE 672-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 20
系列： Stratix®
LAB/CLB數(shù)： 1057
邏輯元件/單元數(shù)： 10570
RAM 位總計： 920448
輸入/輸出數(shù)： 345
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 672-BBGA
供應(yīng)商設(shè)備封裝： 672-BGA（27x27）
其它名稱： 544-1110
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11–2
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
Device Configuration Overview
■
The Remote System Configuration with Stratix & Stratix GX Devices
chapter
f
For more information on setting device configuration options or
generating configuration files, see the Software Setting chapter in
Volume 2 of the Configuration Handbook.
Device
Configuration
Overview
During device operation, the FPGA stores configuration data in SRAM
cells. Because SRAM memory is volatile, you must load the SRAM cells
with the configuration data each time the device powers up. After
configuration, the device must initialize its registers and I/O pins. After
initialization, the device enters user mode. Figure 11–1 shows the state of
the device during the configuration, initialization, and user mode.
Figure 11–1. Stratix & Stratix GX Configuration Cycle
Notes to Figure 11–1:
(1)
During initial power up and configuration, CONF_DONE is low. After configuration, CONF_DONE goes high. If the
device is reconfigured, CONF_DONE goes low after nCONFIG is driven low.
(2)
User I/O pins are tri-stated during configuration. Stratix and Stratix GX devices also have a weak pull-up resistor
on I/O pins during configuration that are enabled by nIO_PULLUP. After initialization, the user I/O pins perform
the function assigned in the user’s design.
(3)
If the INIT_DONE pin is used, it will be high because of an external 10 k
Ω resistor pull-up when nCONFIG is low
and during the beginning of configuration. Once the option bit to enable INIT_DONE is programmed into the device
(during the first frame of configuration data), the INIT_DONE pin will go low.
(4)
DCLK
should not be left floating. It should be driven high or low.
(5)
DATA0
should not be left floating. It should be driven high or low.
You can load the configuration data for the Stratix or Stratix GX device
using a passive configuration scheme. When using any passive
configuration scheme, the Stratix or Stratix GX device is incorporated into
a system with an intelligent host, such as a microprocessor, that controls
the configuration process. The host supplies configuration data from a
storage device (e.g., a hard disk, RAM, or other system memory). When
using passive configuration, you can change the target device’s
High-Z
nCONFIG
nSTATUS
CONF_DONE (1)
DCLK
DATA
User I/O Pins (2)
INIT_DONE (3)
MODE
High-Z
D0
D1
D2
D3
D(N – 1)
DN
Configuration
Initialization
User
High-Z
User I/O
Configuration
(4)
(5)
相關(guān)PDF資料
PDF描述
AMM28DRSN-S288 CONN EDGECARD 56POS .156 EXTEND
EP1S10F672C6 IC STRATIX FPGA 10K LE 672-FBGA
SST39SF020A-55-4I-NHE IC FLASH MPF 2MB 55NS 32PLCC
AMM28DRSH-S288 CONN EDGECARD 56POS .156 EXTEND
AFS600-FG256K IC FPGA 4MB FLASH 600K 256FBGA
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參數(shù)描述
EP1S10F672I7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 1057 LABs 345 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S10F780C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 1057 LABs 426 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S10F780C5N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 1057 LABs 426 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S10F780C6 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 1057 LABs 426 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S10F780C6N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 1057 LABs 426 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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