參數(shù)資料
型號： EP1S10F780C6
廠商： Altera
文件頁數(shù)： 342/864頁
文件大?。?/td> 0K
描述： IC STRATIX FPGA 10K LE 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標(biāo)準(zhǔn)包裝： 18
系列： Stratix®
LAB/CLB數(shù)： 1057
邏輯元件/單元數(shù)： 10570
RAM 位總計(jì)： 920448
輸入/輸出數(shù)： 426
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱： 544-1111
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3–10
Altera Corporation
Stratix Device Handbook, Volume 2
June 2006
DDR Memory Support Overview
DDR Memory
Support
Overview
Table 3–1 shows the external RAM support in Stratix EP1S10 through
EP1S40 devices and all Stratix GX devices. Table 3–2 shows the external
RAM support in Stratix EP1S60 and EP1S80 devices.
Table 3–1. External RAM Support in Stratix EP1S10 through EP1S40 & All Stratix GX Devices
DDR Memory Type
I/O
Standard
Maximum Clock Rate (MHz)
-5 Speed
Grade
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Flip-Chip Flip-Chip
Wire-
Bond
Flip-
Chip
Wire-
Bond
Flip-
Chip
Wire-
Bond
DDR SDRAM (1),
SSTL-2
200
167
133
100
DDR SDRAM - side
banks (2), (3), (4)
SSTL-2
150
133
110
133
100
RLDRAM II (4)
1.8-V HSTL
200
QDR SRAM (6)
1.5-V HSTL
167
133
100
QDRII SRAM (6)
1.5-V HSTL
200
167
133
100
ZBT SRAM (7)
LVTTL
200
167
133
Notes to Table 3–1:
(1)
These maximum clock rates apply if the Stratix device uses DQS phase-shift circuitry to interface with DDR
SDRAM. DQS phase-shift circuitry is only available on the top and bottom I/O banks (I/O banks 3, 4, 7, and 8).
(2)
For more information on DDR SDRAM, see AN 342: Interfacing DDR SDRAM with Stratix & Stratix GX Devices.
(3)
DDR SDRAM is supported on the Stratix device side I/O banks (I/O banks 1, 2, 5, and 6) without dedicated DQS
phase-shift circuitry. The read DQS signal is ignored in this mode.
(4)
These performance specifications are preliminary.
(5)
This device does not support RLDRAM II.
(6)
For more information on QDR or QDRII SRAM, see AN 349: QDR SRAM Controller Reference Design for Stratix &
Stratix GX Devices.
(7)
For more information on ZBT SRAM, see AN 329: ZBT SRAM Controller Reference Design for Stratix and Stratix GX
Devices.
Table 3–2. External RAM Support in Stratix EP1S60 & EP1S80
(Part 1 of 2)
DDR Memory Type
I/O Standard
Maximum Clock Rate (MHz)
-5 Speed Grade
-6 Speed Grade
-7 Speed Grade
DDR SDRAM (1), (2)
SSTL-2
167
133
DDR SDRAM - side banks (2), (3) SSTL-2
150
133
QDR SRAM (4)
1.5-V HSTL
133
QDRII SRAM (4)
1.5-V HSTL
167
133
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