參數資料
| 型號： | EP1S25B672C6 |
| 廠商： | Altera |
| 文件頁數： | 236/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 25K LE 672-BGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 8 |
| 系列： | Stratix® |
| LAB/CLB數： | 2566 |
| 邏輯元件/單元數： | 25660 |
| RAM 位總計： | 1944576 |
| 輸入/輸出數： | 473 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 672-BBGA |
| 供應商設備封裝： | 672-BGA（35x35） |
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Section I–2
Altera Corporation
Clock Management
Stratix Device Handbook, Volume 2
1
November 2003, v2.2
● Updated the “Lock Detect” section.
October 2003, v2.1
● Updated the “VCCG & GNDG” section.
● Updated Figure 1–14.
July 2003, v2.0
● Updated clock multiplication and division, spread spectrum, and Notes 1
and 8 in Table 1-3.
● Updated inclk[1..0] port name in Table 1-4.
● Updated ranges for EPLL post-scale and pre-scale dividers on page 1-9
● Added 1.8V HSTL support for EPLL in Table 1-6 and 1-13.
● New requirement to assert are set signal each PLL when it has to re-
acquire lock on either a new clock after loss of lock (page 1-16)
● Corrected input port extswitch to clkswitch throughout this
chapter.
● Updated clkloss description in Table 1-9.
● Updated text on jitter for spread spectrum on page 1-38.
● Removed PLL specifications. See Chapter 4 of Volume 1.
Chapter
Date/Version
Changes Made
相關PDF資料 |
PDF描述 |
|---|---|
| EP2AGX125DF25C6 | IC ARRIA II GX FPGA 125K 572FBGA |
| AMM24DTAD-S189 | CONN EDGECARD 48POS R/A .156 SLD |
| EP2SGX60CF780C5 | IC STRATIX II GX 60K 780-FBGA |
| RMA50DTMT | CONN EDGECARD 100PS R/A .125 SLD |
| RSA50DTBT | CONN EDGECARD 100PS R/A .125 SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP1S25B672C6N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 2566 LABs 473 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S25B672C7 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 2566 LABs 473 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S25B672C7N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 2566 LABs 473 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S25F1020C5 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 2566 LABs 706 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S25F1020C5N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 2566 LABs 706 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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