參數(shù)資料
型號： EP1S60F1020C6N
廠商： Altera
文件頁數(shù)： 139/864頁
文件大?。?/td> 0K
描述： IC STRATIX FPGA 60K LE 1020-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標(biāo)準(zhǔn)包裝： 8
系列： Stratix®
LAB/CLB數(shù)： 5712
邏輯元件/單元數(shù)： 57120
RAM 位總計(jì)： 5215104
輸入/輸出數(shù)： 773
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應(yīng)商設(shè)備封裝： 1020-FBGA（33x33）
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Altera Corporation
4–43
January 2006
Stratix Device Handbook, Volume 1
DC & Switching Characteristics
Table 4–69. EP1S25 External I/O Timing on Column Pins Using Global Clock Networks
Parameter
-5 Speed Grade
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
Min
Max
tINSU
1.371
1.471
1.657
1.916
ns
tINH
0.000
ns
tOUTCO
2.809
5.516
2.809
5.890
2.809
6.429
2.809
7.155
ns
tXZ
2.749
5.390
2.749
5.758
2.749
6.305
2.749
7.040
ns
tZX
2.749
5.390
2.749
5.758
2.749
6.305
2.749
7.040
ns
tINSUPLL
1.271
1.327
1.491
1.677
ns
tINHPLL
0.000
ns
tOUTCOPLL
1.124
2.396
1.124
2.492
1.124
2.522
1.124
2.602
ns
tXZPLL
1.064
2.270
1.064
2.360
1.064
2.398
1.064
2.487
ns
tZXPLL
1.064
2.270
1.064
2.360
1.064
2.398
1.064
2.487
ns
Table 4–70. EP1S25 External I/O Timing on Row Pins Using Fast Regional Clock Networks
Parameter
-5 Speed Grade
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
Min
Max
tINSU
2.429
2.631
2.990
3.503
ns
tINH
0.000
ns
tOUTCO
2.376
4.821
2.376
5.131
2.376
5.538
2.376
6.063
ns
tXZ
2.403
4.875
2.403
5.187
2.403
5.606
2.403
6.145
ns
tZX
2.403
4.875
2.403
5.187
2.403
5.606
2.403
6.145
ns
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EP1S60F1508C5ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
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