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參數(shù)資料
型號(hào)： EP1S80B956C6
廠商： Altera
文件頁(yè)數(shù)： 94/864頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX FPGA 80K LE 956-BGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標(biāo)準(zhǔn)包裝： 7
系列： Stratix®
LAB/CLB數(shù)： 7904
邏輯元件/單元數(shù)： 79040
RAM 位總計(jì)： 7427520
輸入/輸出數(shù)： 683
電源電壓： 1.425 V ~ 1.575 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 956-BGA
供應(yīng)商設(shè)備封裝： 956-BGA覆晶式（40x40）
其它名稱(chēng)： 544-1437
EP1S80B956C6-ND
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Altera Corporation
4–3
January 2006
Stratix Device Handbook, Volume 1
DC & Switching Characteristics
RCONF
Value of I/O pin pull-
up resistor before
and during
configuration
VCCIO = 3.0 V (9)
20
50
k
Ω
VCCIO = 2.375 V (9)
30
80
k
Ω
VCCIO = 1.71 V (9)
60
150
k
Ω
Table 4–4. LVTTL Specifications
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
VCCIO
Output supply voltage
3.0
3.6
V
VIH
High-level input voltage
1.7
4.1
V
VIL
Low-level input voltage
–0.5
0.7
V
VOH
High-level output voltage
IOH = –4 to –24 mA (10)
2.4
V
VOL
Low-level output voltage
IOL = 4 to 24 mA (10)
0.45
V
Table 4–5. LVCMOS Specifications
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
VCCIO
Output supply voltage
3.0
3.6
V
VIH
High-level input voltage
1.7
4.1
V
VIL
Low-level input voltage
–0.5
0.7
V
VOH
High-level output voltage
VCCIO = 3.0,
IOH = –0.1 mA
VCCIO – 0.2
V
VOL
Low-level output voltage
VCCIO = 3.0,
IOL = 0.1 mA
0.2
V
Table 4–6. 2.5-V I/O Specifications
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
VCCIO
Output supply voltage
2.375
2.625
V
VIH
High-level input voltage
1.7
4.1
V
VIL
Low-level input voltage
–0.5
0.7
V
VOH
High-level output voltage
IOH = –1 mA (10)
2.0
V
VOL
Low-level output voltage
IOL = 1 mA (10)
0.4
V
Table 4–3. Stratix Device DC Operating Conditions Note (7) (Part 2 of 2)
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Unit
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PDF描述
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93C56CT-I/MC IC EEPROM 2KBIT 3MHZ 8DFN
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