參數資料
| 型號： | EP1S80F1508C6 |
| 廠商： | Altera |
| 文件頁數： | 271/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 80K LE 1508-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產品變化通告： | Package Height Change 03/March/2008 |
| 標準包裝： | 7 |
| 系列： | Stratix® |
| LAB/CLB數： | 7904 |
| 邏輯元件/單元數： | 79040 |
| RAM 位總計： | 7427520 |
| 輸入/輸出數： | 1203 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1508-BBGA |
| 供應商設備封裝： | 1508-FBGA（30x30） |
| 其它名稱： | 544-1441 |
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1–32
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
Fast PLLs
general purpose abilities of the Fast PLL. For information on the high-
speed differential I/O interface capabilities, see the High-Speed Differential
I/O Interfaces in Stratix Devices chapter.
Figure 1–17. Stratix & Stratix GX Fast PLL Block Diagram
Notes to Figure 1–17:
(1)
The global or regional clock input can be driven by an output from another PLL or any dedicated CLK or FCLK pin.
It cannot be driven by internally-generated global signals.
(2)
In high-speed differential I/O support mode, this high-speed PLL clock feeds the SERDES. Stratix and Stratix GX
devices only support one rate of data transfer per fast PLL in high-speed differential I/O support mode.
(3)
This signal is a high-speed differential I/O support SERDES control signal.
Charge
Pump
VCO
÷g0
8
Clock
Input
PFD
÷l1
÷l0
÷m
Loop
Filter
Phase
Frequency
Detector
VCO Phase Selection
Selectable at each PLL
Output Port
Post-Scale
Counters
Global or
regional clock
Global or
regional clock
Global or
regional clock
diffioclk2 (2)
diffioclk1 (2)
txload_en (3)
rxload_en (3)
Global or
regional clock (1)
相關PDF資料 |
PDF描述 |
|---|---|
| EP1S80B956C6 | IC STRATIX FPGA 80K LE 956-BGA |
| 24AA08H-I/P | IC EEPROM 8KBIT 400KHZ 8DIP |
| 24AA014H-I/P | IC EEPROM 1KBIT 400KHZ 8DIP |
| 34LC02-I/SN | IC EEPROM 2KBIT 1MHZ 8SOIC |
| 93C56CT-I/MC | IC EEPROM 2KBIT 3MHZ 8DFN |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP1S80F1508C6ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508C6N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S80F1508C7 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S80F1508C7ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508C7N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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