參數資料
型號： EP1SGX10DF672C6N
廠商： Altera
文件頁數： 6/1456頁
文件大?。?/td> 0K
描述： IC STRATIX GX FPGA 10KLE 672FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 20
系列： Stratix® GX
LAB/CLB數： 1057
邏輯元件/單元數： 10570
RAM 位總計： 920448
輸入/輸出數： 362
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 672-BBGA
供應商設備封裝： 672-BGA（27x27）
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14–14
Altera Corporation
Stratix GX Device Handbook, Volume 2
July 2005
Using TriMatrix Memory
Figure 14–7. True Dual-Port Timing Waveforms
Implementing Shift-Register Mode
Embedded memory block configurations can implement shift registers
for digital signal processing (DSP) applications, such as finite impulse
response (FIR) filters, pseudo-random number generators, multi-channel
filtering, and auto-correlation and cross-correlation functions. These and
other DSP applications require local data storage, traditionally
implemented with standard flip-flops that can quickly consume many
logic cells for large shift registers. A more efficient alternative is to use
embedded memory as a shift register block, which saves logic cell and
routing resources and provides a more efficient implementation.
The size of a (w
× m × n) shift register is determined by the input data
width (w), the length of the taps (m), and the number of taps (n). The size
of a (w
× m × n) shift register must be less than or equal to the maximum
number of memory bits in the respective block: 576 bits for the M512
block and 4,608 bits for the M4K block. In addition, the size of w
× n must
be less than or equal to the maximum width of the respective block: 18
bits for the M512 block and 36 bits for the M4K block. If a larger shift
register is required, the memory blocks can be cascaded together.
1
M-RAM blocks do not support the shift-register mode.
A_clk
A_wren
A_address
A_data_in
B_synch_data_out
an-1
an
a0
a1
a2
a3
a4
a5
din-1
din
din4
din5
B_clk
a6
din6
B_asynch_data_out
B_wren
B_address
bn
b0
b1
b2
b3
doutn-2
doutn-1
doutn
doutn-1
doutn
dout0
A_synch_data_out
A_asynch_data_out
dout0
dout1
dout2
din-2
din-1
din
dout0
dout1
dout2
dout3
din4
din-1
din
dout0
dout1
dout2
dout3
din4
din5
相關PDF資料
PDF描述
180-078-172L010 CONN DB78 MALE HD CRIMP TIN
EPF10K100EQC240-1X IC FLEX 10KE FPGA 100K 240-PQFP
180-062-273L000 CONN DB62 FEMALE HD CRIMP NICKEL
180-078-173L000 CONN DB78 MALE HD CRIMP NICKEL
180-078-273L000 CONN DB78 FEMALE HD CRIMP NICKEL
相關代理商/技術參數
參數描述
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EP1SGX10DF672I6 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I GX 1057 LABs 362 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX10DF672I6N 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I GX 1057 LABs 362 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX25 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:1. Enhanced Configuration Devices (EPC4, EPC8, and EPC16) Data Sheet
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