參數(shù)資料
型號(hào): EP2AGX125EF35C6
廠商: Altera
文件頁(yè)數(shù): 27/90頁(yè)
文件大?。?/td> 0K
描述: IC ARRIA II GX 125K 1152FBG
產(chǎn)品培訓(xùn)模塊: Arria II GX FPGA
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品: Arria? II GX FPGAs
標(biāo)準(zhǔn)包裝: 3
系列: Arria II GX
LAB/CLB數(shù): 4964
邏輯元件/單元數(shù): 118143
RAM 位總計(jì): 8315904
輸入/輸出數(shù): 452
電源電壓: 0.87 V ~ 0.93 V
安裝類(lèi)型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 1152-BBGA
供應(yīng)商設(shè)備封裝: 1152-FBGA(27x27)
配用: 544-2600-ND - KIT DEV ARRIA II GX FPGA 2AGX125
其它名稱(chēng): 544-2597-5
EP2AGX125EF35C6ES
EP2AGX125EF35C6ES-ND
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Arria
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A
LTD lock time
0
100
4000
0
100
4000
0
100
4000
0
100
4000
ns
Data lock time
from rx_
freqlocked
4000
4000
4000
4000
ns
Programmable
DC gain
DC Gain
Setting = 0
—0
0
0
0
dB
DC Gain
Setting = 1
—3
3
3
3
dB
DC Gain
Setting = 2
—6
6
6
6
dB
Transmitter
Supported I/O
Standards
1.5-V PCML
Data rate
600
6375
600
3750
600
3750
600
3125
Mbps
VOCM
0.65 V
setting
650
650
650
650
mV
Differential
on-chip
termination
resistors
100
setting
100
100
100
100
Return loss
differential mode
PCIe
50 MHz to 1.25 GHz: –10dB
XAUI
312 MHz to 625 MHz: –10dB
625 MHz to 3.125 GHz: –10dB/decade slope
Return loss
common mode
PCIe
50 MHz to 1.25 GHz: –6dB
Rise time (2)
50
200
50
200
50
200
50
200
ps
Fall time
50
200
50
200
50
200
50
200
ps
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 5 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
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