參數(shù)資料
型號(hào)： EP2AGX125EF35I5N
廠商： Altera
文件頁(yè)數(shù)： 22/90頁(yè)
文件大?。?/td> 0K
描述： IC ARRIA II GX 125K 1152FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Arria II GX
LAB/CLB數(shù)： 4964
邏輯元件/單元數(shù)： 118143
RAM 位總計(jì)： 8315904
輸入/輸出數(shù)： 452
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1152-BBGA
供應(yīng)商設(shè)備封裝： 1152-FBGA（27x27）
Ch
ap
te
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1:
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Da
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Cor
p
oration
A
Switching Characteristics
This section provides performance characteristics of the Arria II GX and GZ core and periphery blocks for commercial grade
devices. The following tables are considered final and are based on actual silicon characterization and testing. These numbers
reflect the actual performance of the device under worst-case silicon process, voltage, and junction temperature conditions.
Transceiver Performance Specifications
Table 1–34 lists the Arria II GX transceiver specifications.
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 1 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Reference Clock
Supported I/O
Standards
1.2-V PCML, 1.5-V PCML, 2.5-V PCML, Differential LVPECL, LVDS, and HCSL
Input frequency
from REFCLK
input pins
—
50
—
622.08
50
—
622.08
50
—
622.08
50
—
622.08
MHz
Input frequency
from PLD input
—
50
—
200
50
—
200
50
—
200
50
—
200
MHz
Absolute VMAX
for a REFCLK pin
—
2.2
—
2.2
—
2.2
—
2.2
V
Absolute VMIN for
a REFCLK pin
—
–0.3
—
–0.3
—
–0.3
—
–0.3
—
V
Rise/fall time (2)
—
0.2
—
0.2
—
0.2
—
0.2
UI
Duty cycle
—
45
—
55
45
—
55
45
—
55
45
—
55
%
Peak-to-peak
differential input
voltage
—
200
—
2000
200
—
2000
200
—
2000
200
—
2000
mV
Spread-spectrum
modulating clock
frequency
PCIe
30
—
33
30
—
33
30
—
33
30
—
33
kHz
相關(guān)PDF資料
PDF描述
24C01CT/SN IC EEPROM 1KBIT 400KHZ 8SOIC
AYM36DTAS CONN EDGECARD 72POS R/A .156 SLD
AGM36DTAS CONN EDGECARD 72POS R/A .156 SLD
24LC01BT-E/SN IC EEPROM 1KBIT 400KHZ 8SOIC
24LC02B/ST IC EEPROM 2KBIT 400KHZ 8TSSOP
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