參數資料
| 型號： | EP2AGX45CU17C4 |
| 廠商： | Altera |
| 文件頁數： | 33/90頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC ARRIA II GX FPGA 45K 358UBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 6 |
| 系列： | Arria II GX |
| LAB/CLB數： | 1805 |
| 邏輯元件/單元數： | 42959 |
| RAM 位總計： | 3517440 |
| 輸入/輸出數： | 156 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 358-UBGA |
| 供應商設備封裝： | 358-UBGA |
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Chapter 1: Device Datasheet for Arria II Devices
1–31
Switching Characteristics
December 2013
Altera Corporation
Transmitter
Supported I/O Standards
1.5-V PCML
Data rate (14)
—
600
—
6375
600
—
3750
Mbps
VOCM
0.65 V setting
—
650
—
650
—
mV
Differential on-chip
termination resistors
85
setting
85 ± 15%
100
setting
100 ± 15%
120
setting
120 ± 15%
150-
setting
150 ± 15%
Differential and common
mode return loss
PCIe Gen1 and
Gen2 (TX VOD=4),
XAUI (TX VOD=6),
HiGig+
(TX VOD=6),
CEI SR/LR
(TX VOD=8),
SRIO SR (VOD=6),
SRIO LR (VOD=8),
CPRI LV (VOD=6),
CPRI HV (VOD=2),
OBSAI (VOD=6),
SATA (VOD=4),
Compliant
—
Rise time (15)
—
50
—
200
50
—
200
ps
Fall time (15)
—
50
—
200
50
—
200
ps
Intra-differential pair skew
—
15
—
15
ps
Intra-transceiver block
transmitter
channel-to-channel skew
×4 PMA and PCS
bonded mode
Example: XAUI,
PCIe ×4, Basic ×4
——
120
—
—120
ps
Inter-transceiver block
transmitter
channel-to-channel skew
×8 PMA and PCS
bonded mode
Example: PCIe ×8,
Basic ×8
——
500
—
—500
ps
CMU0 PLL and CMU1 PLL
Supported Data Range
—
600
—
6375
600
—
3750
Mbps
pll_powerdown
minimum
pulse width
(tpll_powerdown)
—1
1
s
CMU PLL lock time from
pll_powerdown
de-assertion
—
100
—
100
s
Table 1–35. Transceiver Specifications for Arria II GZ Devices (Part 4 of 5)
Symbol/
Description
Conditions
–C3 and –I3 (1)
–C4 and –I4
Unit
Min
Typ
Max
Min
Typ
Max
相關PDF資料 |
PDF描述 |
|---|---|
| EP3SL50F484C3N | IC STRATIX III L 50K 484-FBGA |
| EP1S25F672C8N | IC STRATIX FPGA 25K LE 672-FBGA |
| EP2AGX65DF25C6N | IC ARRIA II GX FPGA 65K 572FBGA |
| ABB80DHFR | CONN EDGECARD 160POS .050 SMD |
| A42MX36-1BG272I | IC FPGA MX SGL CHIP 54K 272-PBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP2AGX45CU17C4N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 1805 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX45CU17C5 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 1805 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX45CU17C5N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 1805 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX45CU17C6 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 1805 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX45CU17C6N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 1805 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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