參數資料
| 型號： | EP2AGX45DF25C5N |
| 廠商： | Altera |
| 文件頁數： | 40/90頁 |
| 文件大小： | 0K |
| 描述： | IC ARRIA II GX FPGA 45K 572FBGA |
| 產品培訓模塊： | Arria II GX FPGA Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 5 |
| 系列： | Arria II GX |
| LAB/CLB數： | 1805 |
| 邏輯元件/單元數： | 42959 |
| RAM 位總計： | 3517440 |
| 輸入/輸出數： | 252 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 572-FBGA |
| 供應商設備封裝： | 572-FBGA |
| 其它名稱： | 544-2643 |
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Chapter 1: Device Datasheet for Arria II Devices
1–37
Switching Characteristics
December 2013
Altera Corporation
Table 1–40 lists the transceiver jitter specifications for all supported protocols for
Arria II GX devices.
29
N/A
12.5
9.6
7.7
6.3
4.3
30
N/A
11.4
9
7.4
N/A
31
N/A
12.9
10
8.2
N/A
Table 1–39. Transmitter Pre-Emphasis Levels for Arria II GZ Devices (Part 2 of 2)
Pre-
Emphasis
1st
Post-Tap
Setting
VOD Setting
012345
67
Table 1–40. Transceiver Block Jitter Specifications for Arria II GX Devices (Note 1) (Part 1 of 10)
Symbol/
Description
Conditions
I3
C4
C5, I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SONET/SDH Transmit Jitter Generation (2)
Peak-to-peak
jitter at
622.08 Mbps
Pattern =
PRBS15
—
0.1
—
0.1
—
0.1
—
0.1
UI
RMS jitter at
622.08 Mbps
Pattern =
PRBS15
—
0.01
—
0.01
—
0.01
—
0.01
UI
Peak-to-peak
jitter at
2488.32 Mbps
Pattern =
PRBS15
—
0.1
—
0.1
—
0.1
—
0.1
UI
RMS jitter at
2488.32 Mbps
Pattern =
PRBS15
—
0.01
—
0.01
—
0.01
—
0.01
UI
SONET/SDH Receiver Jitter Tolerance (2)
Jitter tolerance at
622.08 Mbps
Jitter frequency =
0.03 KHz
Pattern = PRBS15
> 15
UI
Jitter frequency =
25 KHZ
Pattern = PRBS15
> 1.5
UI
Jitter frequency =
250 KHz
Pattern = PRBS15
> 0.15
UI
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