參數(shù)資料
型號： EP2S180F1020I4N
廠商： Altera
文件頁數(shù)： 408/768頁
文件大小： 0K
描述： IC STRATIX II FPGA 180K 1020FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 6
系列： Stratix® II
LAB/CLB數(shù)： 8970
邏輯元件/單元數(shù)： 179400
RAM 位總計： 9383040
輸入/輸出數(shù)： 742
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1020-BBGA
供應商設備封裝： 1020-FBGA（33x33）
配用： 544-1701-ND - DSP PRO KIT W/SII EP2S180N
其它名稱： 544-2163
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4–28
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
On-Chip Termination
The Stratix II and Stratix II GX devices supports I/O driver on-chip series
(RS) and parallel (RT) termination through drive strength control for
single-ended I/Os. There are three ways to implement the RS and (RT) in
Stratix II and Stratix II GX devices:
■
RS without calibration for both row I/Os and column I/Os
■
RS with calibration only for column I/Os
■
RT with calibration only for column I/Os
On-Chip Series Termination without Calibration
Stratix II and Stratix II GX devices support driver impedance matching to
provide the I/O driver with controlled output impedance that closely
matches the impedance of the transmission line. As a result, reflections
can be significantly reduced. Stratix II and Stratix II GX devices support
on-chip series termination for single-ended I/O standards (see
Figure 4–23). The RS shown in Figure 4–23 is the intrinsic impedance of
transistors. The typical RS values are 25 and 50. Once matching
impedance is selected, current drive strength is no longer selectable.
1
On-chip series termination without calibration is supported on
output pins or on the output function of bidirectional pins.
Figure 4–23. Stratix II and Stratix II GX On-Chip Series Termination without
Calibration
Stratix II Driver
Series Impedance
Receiving
Device
VCCIO
RS
ZO
GND
相關PDF資料
PDF描述
EP2S180F1020C3N IC STRATIX II FPGA 180K 1020FBGA
93C46B-E/P IC EEPROM 1KBIT 2MHZ 8DIP
24LC32AT/SN IC EEPROM 32KBIT 400KHZ 8SOIC
24AA16/P IC EEPROM 16KBIT 400KHZ 8DIP
24LC32AT-I/SN IC EEPROM 32KBIT 400KHZ 8SOIC
相關代理商/技術參數(shù)
參數(shù)描述
EP2S180F1508C3 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S180F1508C3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S180F1508C4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S180F1508C4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S180F1508C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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