參數(shù)資料
型號： EP2S180F1508C5N
廠商： Altera
文件頁數(shù)： 387/768頁
文件大?。?/td> 0K
描述： IC STRATIX II FPGA 180K 1508FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 7
系列： Stratix® II
LAB/CLB數(shù)： 8970
邏輯元件/單元數(shù)： 179400
RAM 位總計： 9383040
輸入/輸出數(shù)： 1170
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1508-BBGA
供應商設備封裝： 1508-FBGA（30x30）
配用： 544-1701-ND - DSP PRO KIT W/SII EP2S180N
其它名稱： 544-1888
EP2S180F1508C5N-ND
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Altera Corporation
4–9
January 2008
Stratix II Device Handbook, Volume 2
Selectable I/O Standards in Stratix II and Stratix II GX Devices
Figure 4–5. 1.8-V HSTL Class I Termination
Figure 4–6. 1.8-V HSTL Class II Termination
1.5-V HSTL Class I and 1.5-V HSTL Class II
The 1.5-V HSTL standard is formulated under EIA/JEDEC Standard,
EIA/JESD8-6: A 1.5-V Output Buffer Supply Voltage Based Interface
Standard for Digital Integrated Circuits.
The 1.5-V HSTL I/O standard is used for applications designed to operate
in the 0.0- to 1.5-V HSTL logic nominal switching range. This standard
defines single-ended input and output specifications for all
HSTL-compliant digital integrated circuits. The 1.5-V HSTL I/O standard
in Stratix II and Stratix II GX devices are compatible with the 1.8-V HSTL
I/O standard in APEX 20KE, APEX 20KC, and in Stratix II and
Stratix II GX devices themselves because the input and output voltage
thresholds are compatible (Figures 4–7 and 4–8).
1
Stratix II and Stratix II GX devices support both input and
output levels with VREF and VTT.
Output Buffer
Input Buffer
VTT = 0.9 V
50
Ω
Z = 50
Ω
VREF = 0.9 V
Output Buffer
Input Buffer
VTT = 0.9 V
50
Ω
Z = 50
Ω
VREF = 0.9 V
VTT = 0.9 V
50
Ω
相關PDF資料
PDF描述
AYM43DRST CONN EDGECARD 86POS DIP .156 SLD
030-1953-002 CONTACT DSUB SKT 26-30AWG CRIMP
EP4SGX290KF40C4 IC STRATIX IV FPGA 290K 1517FBGA
ASM43DRST CONN EDGECARD 86POS DIP .156 SLD
EP4SGX230KF40I4N IC STRATIX IV FPGA 230K 1517FBGA
相關代理商/技術參數(shù)
參數(shù)描述
EP2S180F1508I4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S180F1508I4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 1170 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S30 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:1. Enhanced Configuration Devices (EPC4, EPC8, and EPC16) Data Sheet
EP2S30F484C3 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S30F484C3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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