參數(shù)資料
型號： EP2S30F672C5N
廠商： Altera
文件頁數(shù)： 738/768頁
文件大?。?/td> 0K
描述： IC STRATIX II FPGA 30K 672-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 10
系列： Stratix® II
LAB/CLB數(shù)： 1694
邏輯元件/單元數(shù)： 33880
RAM 位總計(jì)： 1369728
輸入/輸出數(shù)： 500
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 672-BBGA
供應(yīng)商設(shè)備封裝： 672-BGA（27x27）
其它名稱： 544-1898
EP2S30F672C5N-ND
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Altera Corporation
11–27
May 2007
Stratix II Device Handbook, Volume 2
High-Speed Board Layout Guidelines
Figure 11–34. Filtering Noise with a Ferrite Bead
Usually, elements on the PCB add high-frequency noise to the power
plane. To filter the high-frequency noise at the device, place decoupling
capacitors as close as possible to each VCC and GND pair.
f
See the Operating Requirements for Altera Devices Data Sheet for more
information on bypass capacitors.
Power Distribution
A system can distribute power throughout the PCB with either power
planes or a power bus network.
You can use power planes on multi-layer PCBs that consist of two or more
metal layers that carry VCC and GND to the devices. Because the power
plane covers the full area of the PCB, its DC resistance is very low. The
power plane maintains VCC and distributes it equally to all devices while
providing very high current-sink capability, noise protection, and
shielding for the logic signals on the PCB. Altera recommends using
power planes to distribute power.
The power bus network—which consists of two or more wide-metal
traces that carry VCC and GND to devices—is often used on two-layer
PCBs and is less expensive than power planes. When designing with
power bus networks, be sure to keep the trace widths as wide as possible.
The main drawback to using power bus networks is significant DC
resistance.
Altera recommends using separate analog and digital power planes. For
fully digital systems that do not already have a separate analog power
plane, it can be expensive to add new power planes. However, you can
create partitioned islands (split planes). Figure 11–35 shows an example
board layout with phase-locked loop (PLL) ground islands.
VCC Source
Ferrite Bead
VCC
10
μF
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PDF描述
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