參數資料
型號： EP2SGX130GF1508I4
廠商： Altera
文件頁數： 1318/1486頁
文件大?。?/td> 0K
描述： IC STRATIX II GX 130K 1508-FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 7
系列： Stratix® II GX
LAB/CLB數： 6627
邏輯元件/單元數： 132540
RAM 位總計： 6747840
輸入/輸出數： 734
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1508-BBGA
供應商設備封裝： 1508-FBGA（30x30）
其它名稱： 544-2174
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Altera Corporation
4–109
October 2007
Stratix II GX Device Handbook, Volume 2
Stratix II GX ALT2GXB Megafunction User Guide
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debug_rx_phase_comp_fi
fo_error
output port
This optional output port indicates Receiver Phase
Compensation FIFO overflow/underrun condition.
Note that no PPM difference is allowed between
FIFO read and write clocks. This port should be
used for debug purpose only.
Receiver Phase
Compensation FIFO
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create
debug_tx_phase_comp_fi
fo_error
output port
This optional output port indicates Transmitter
Phase Compensation FIFO overflow/underrun
condition. Note that no PPM difference is allowed
between FIFO read and write clocks. This port
should be used for debug purpose only.
Transmitter Phase
Compensation FIFO
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_coreclk port to
connect to the read clock of the
RX phase compensation FIFO
This optional input port allows you to clock the
read side of the Receiver Phase Compensation
FIFO with a non-transceiver PLD clock.
Transceiver Clocking
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create tx_coreclk port to
connect to the write clock of the
TX phase compensation FIFO
This optional input port allows you to clock the
write side of the Transmitter Phase Compensation
FIFO with a non-transceiver PLD clock.
Transceiver Clocking
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Table 4–38. MegaWizard Plug-In Manager Options (Page 4 for SONET/SDH Mode) (Part 3 of 3)
ALT2GXB Setting
Description
Reference
相關PDF資料
PDF描述
AGM40DRMD-S288 CONN EDGECARD EXTEND 80POS .156
EP4SGX230DF29I3 IC STRATIX IV FPGA 230K 780FBGA
EP4SGX230DF29C2X IC STRATIX IV FPGA 230K 780FBGA
EP4SGX230HF35I3N IC STRATIX IV FPGA 230K 1152FBGA
HSM43DSAI CONN EDGECARD 86POS R/A .156 SLD
相關代理商/技術參數
參數描述
EP2SGX130GF1508I4N 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix II GX 6627 LABs 734 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX130GF40C3N 功能描述:IC STRATIX II GX 130K 1508-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:Stratix® II GX 產品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數:100 邏輯元件/單元數:238 RAM 位總計:3200 輸入/輸出數:80 門數:3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應商設備封裝:120-CPGA（34.55x34.55）
EP2SGX130GF40C4ES 功能描述:IC STRATIX II GX 130K 1508-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:Stratix® II GX 產品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數:100 邏輯元件/單元數:238 RAM 位總計:3200 輸入/輸出數:80 門數:3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應商設備封裝:120-CPGA（34.55x34.55）
EP2SGX130GF40C4NES 功能描述:IC STRATIX II GX 130K 1508-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:Stratix® II GX 產品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數:100 邏輯元件/單元數:238 RAM 位總計:3200 輸入/輸出數:80 門數:3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應商設備封裝:120-CPGA（34.55x34.55）
EP2SGX130GF40C5 功能描述:IC STRATIX II GX 130K 1508-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:Stratix® II GX 產品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標準包裝:24 系列:XC4000E/X LAB/CLB數:100 邏輯元件/單元數:238 RAM 位總計:3200 輸入/輸出數:80 門數:3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應商設備封裝:120-CPGA（34.55x34.55）
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