參數資料
| 型號： | EP4SGX180KF40C4N |
| 廠商： | Altera |
| 文件頁數： | 49/82頁 |
| 文件大小： | 0K |
| 描述： | IC STRATIX IV FPGA 180K 1517FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 3 |
| 系列： | Stratix® IV GX |
| LAB/CLB數： | 7030 |
| 邏輯元件/單元數： | 175750 |
| RAM 位總計： | 13954048 |
| 輸入/輸出數： | 744 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1517-BBGA |
| 供應商設備封裝： | 1517-FBGA（40x40） |
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Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–45
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
Table 1–31 lists the transceiver jitter specifications for protocols supported by
Stratix IV GT devices.
Table 1–31. Transceiver Jitter Specifications for Protocols by Stratix IV GT Devices (Part 1 of 2)
Symbol/
Description
Conditions
–1 Industrial Speed
Grade
–2 Industrial Speed
Grade
–3 Industrial Speed
Grade
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
XLAUI/CAUI Transmit Jitter Generation (1), (3)
Total Jitter
Pattern = PRBS-31
VOD = 800 mV
REFCLK
= 644.53 MHz
4 (XLAUI)/
10 (CAUI) channels in
Basic ×1 mode
—
0.30
—
0.30
—
0.30
UI
Deterministic
Jitter
—
0.17
—
0.17
—
0.17
UI
XLAUI/CAUI Receiver Jitter Tolerance (1)
Total Jitter
tolerance
Pattern = PRBS-31
> 0.62
—
UI
Sinusoidal Jitter
tolerance
Jitter Frequency = 40 KHz
Pattern = PRBS-31
Equalization = Disabled
BER = 1E-12
> 5
—
UI
Jitter Frequency
4MHz
Pattern = PRBS-31
Equalization = Disabled
BER = 1E-12
> 0.05
—
UI
XFI Transmitter Jitter Generation (2), (3)
Total jitter at
10.3125 Gbps
Pattern =
PRBS-31
Vod = 800 mV
REFCLK =
644.53 MHz
10 channels in Basic ×1 mode
—
0.3
—
0.3
—
UI
Total Jitter at
11.18 Gbps
Pattern = PRBS-31
VOD = 800 mV
REFCLK
= 698.75 MHz
—
0.30
—
0.30
—
0.30
UI
Deterministic
Jitter
—
0.17
—
0.17
—
0.17
UI
相關PDF資料 |
PDF描述 |
|---|---|
| HMM12DREN | CONN EDGECARD 24POS .156 EYELET |
| HMM12DREH | CONN EDGECARD 24POS .156 EYELET |
| EP4SGX180FF35C4 | IC STRATIX IV FPGA 180K 1152FBGA |
| A42MX36-CQ208B | IC FPGA MX SGL CHIP 54K 208-CQFP |
| HSM43DRAS | CONN EDGECARD 86POS R/A .156 SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP4SGX180KF40I3 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix IV GX 7030 LABs 744 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4SGX180KF40I3N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix IV GX 7030 LABs 744 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4SGX180KF40I4 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix IV GX 7030 LABs 744 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4SGX180KF40I4N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix IV GX 7030 LABs 744 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4SGX230 | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix IV Device |
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