參數(shù)資料
型號(hào)： EP4SGX360HF35C3N
廠商： Altera
文件頁(yè)數(shù)： 55/82頁(yè)
文件大小： 0K
描述： IC STRATIX IV GX 360K 1152FBGA
產(chǎn)品培訓(xùn)模塊： Stratix IV FPGAs
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品： Stratix? IV Series FPGAs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 14144
邏輯元件/單元數(shù)： 353600
RAM 位總計(jì)： 23105536
輸入/輸出數(shù)： 564
電源電壓： 0.87 V ~ 0.93 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1152-BBGA
供應(yīng)商設(shè)備封裝： 1152-FBGA（27x27）
其它名稱(chēng)： 544-2623
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–51
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
TriMatrix Memory Block Specifications
Table 1–36 lists the Stratix IV TriMatrix memory block specifications.
Table 1–36. TriMatrix Memory Block Performance Specifications for Stratix IV Devices (1) (Part 1 of 2)
Memory
Mode
Resources Used
Performance
ALUTs
TriMatrix
Memory
–1 Industrial
and –2 /–2×
Commercial/
Industrial
Speed Grade
–3
Commercial/
Industrial/
Military
Speed Grade
–4
Commercial/
Industrial
Speed Grade
–3
Industrial/
Military
Speed
Grade
–4
Industrial
Speed
Grade
Unit
MLAB
Single port
64×10
0
1
600
500
450
500
450
MHz
Simple dual-port
32×20
0
1
600
500
450
500
450
MHz
Simple dual-port
64×10
0
1
600
500
450
500
450
MHz
ROM 64×10
0
1
600
500
450
500
450
MHz
ROM 32×20
0
1
600
500
450
500
450
MHz
M9K
Block
Single-port
256×36
0
1
600
540
475
540
475
MHz
Simple dual-port
256×36
0
1
550
490
420
490
420
MHz
Simple dual-port
256×36, with the
read-during-write
option set to Old
Data
0
1
375
340
300
340
300
MHz
True dual port
512×18
0
1
490
430
370
430
370
MHz
True dual-port
512×18, with the
read-during-write
option set to Old
Data
0
1
375
335
290
335
290
MHz
ROM 1 Port
0
1
600
540
475
540
475
MHz
ROM 2 Port
0
1
600
540
475
540
475
MHz
Min Pulse Width
(clock high time)
—
750
800
850
800
850
ps
Min Pulse Width
(clock low time)
—
500
625
690
625
690
ps
相關(guān)PDF資料
PDF描述
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