參數(shù)資料
型號(hào)： EP4SGX530KF43I4N
廠(chǎng)商： Altera
文件頁(yè)數(shù)： 47/82頁(yè)
文件大小： 0K
描述： IC STRATIX IV FPGA 530K 1760FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 21248
邏輯元件/單元數(shù)： 531200
RAM 位總計(jì)： 28033024
輸入/輸出數(shù)： 880
電源電壓： 0.87 V ~ 0.93 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1760-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 1760-FCBGA
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–43
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
OBSAI Transmit Jitter Generation (19)
Total jitter at 768 Mbps,
1536 Mbps, and
3072 Mbps
REFCLK = 153.6MHz
Pattern = CJPAT
—
0.35
—
0.35
—
0.35
UI
Deterministic jitter at
768 Mbps, 1536 Mbps,
and 3072 Mbps
REFCLK = 153.6MHz
Pattern = CJPAT
—
0.17
—
0.17
—
0.17
UI
OBSAI Receiver Jitter Tolerance (19)
Deterministic jitter
tolerance at 768 Mbps,
1536 Mbps, and
3072 Mbps
Pattern = CJPAT
> 0.37
UI
Combined deterministic
and random jitter
tolerance at 768 Mbps,
1536 Mbps, and
3072 Mbps
Pattern = CJPAT
> 0.55
UI
Sinusoidal Jitter
tolerance at 768 Mbps
Jitter Frequency =
5.4 KHz
Pattern = CJPAT
> 8.5
UI
Jitter Frequency =
460 MHz to 20 MHz
Pattern = CJPAT
> 0.1
UI
Sinusoidal Jitter
tolerance at 1536 Mbps
Jitter Frequency =
10.9 KHz
Pattern = CJPAT
> 8.5
UI
Jitter Frequency =
921.6 MHz to 20 MHz
Pattern = CJPAT
> 0.1
UI
Table 1–30. Transceiver Block Jitter Specifications for Stratix IV GX Devices (1), (2) (Part 8 of 9)
Symbol/
Description
Conditions
–2 Commercial
Speed Grade
–3 Commercial/
Industrial
and –2× Commercial
Speed Grade
–3 Military (3) and
–4 Commercial/
Industrial Speed
Grade
Unit
Min
Typ
Max
Min
Typ
Max
Min Typ
Max
相關(guān)PDF資料
PDF描述
93C46AT-E/MNY IC EEPROM SER 1K 1.8V 8TDFN
93LC46BT-E/MNY IC EEPROM SER 1K 2.5V 8TDFN
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24LC025T-E/SN IC EEPROM 2KBIT 400KHZ 8SOIC
24LC024-E/SN IC EEPROM 2KBIT 400KHZ 8SOIC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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