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參數(shù)資料
| 型號(hào)： | EP7312-CR |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 40/54頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC ARM720T MCU 74MHZ 204-TFBGA |
| 標(biāo)準(zhǔn)包裝： | 119 |
| 系列： | EP7 |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 32-位 |
| 速度： | 74MHz |
| 連通性： | 編解碼器，DAI，EBI/EMI，IrDA，鍵盤(pán)，SPI/Microwire1，UART/USART |
| 外圍設(shè)備： | LCD，LED，MaverickKey，PWM |
| 輸入/輸出數(shù)： | 27 |
| 程序存儲(chǔ)器類(lèi)型： | ROMless |
| RAM 容量： | 56K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.3 V ~ 2.7 V |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 204-TFBGA |
| 包裝： | 托盤(pán) |
| 配用： | 598-1209-ND - KIT DEVELOPMENT EP73XX ARM7 |
| 其它名稱： | 598-1235 |
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DS508F2
Copyright Cirrus Logic, Inc. 2011
(All Rights Reserved)
45
EP7312
High-Performance, Low-Power System on Chip
*
“With p/u” means with internal pull-up of 100 KOhms on the pin.
Strength 1 = 4 ma
Strength 2 = 12 ma
Input. Port A,B,D,E GPIOs default to input at nPOR and URESET conditions.
JTAG Boundary Scan Signal Ordering
R5
SSITXDA
1
Low
O
DAI/CODEC/SSI2 serial data output
R6
nADCCS
1
High
O
SSI1 ADC chip select
R7
VDDIO
Pad power
Digital I/O power, 3.3V
R8
ADCOUT
1
Low
O
SSI1 ADC serial data output
R9
COL[7]
1
High
O
Keyboard scanner column drive
R10
COL[3]
1
High
O
Keyboard scanner column drive
R11
COL[1]
1
High
O
Keyboard scanner column drive
R12
D[30]
1
Low
I/O
Data I/O
R13
A[27]/DRA[0]
2
Low
O
System byte address / SDRAM address
R14
A[25]/DRA[2]
2
Low
O
System byte address / SDRAM address
R15
VDDIO
Pad power
Digital I/O power, 3.3V
R16
A[24]/DRA[3]
1
Low
O
System byte address / SDRAM address
T1
VDDRTC
RTC power
Real time clock power, 2.5V
T2
PD[7]/SDQM[1]
1
Low
I/O
GPIO port D / SDRAM byte lane mask
T3
PD[6]/SDQM[0]
1
Low
I/O
GPIO port D / SDRAM byte lane mask
T4
PD[3]
1
Low
I/O
GPIO port D
T5
SSICLK
1
Input
I/O
DAI/CODEC/SSI2 serial clock
T6
SSIRXFR
1
Input
I/O
DAI/CODEC/SSI2 frame sync
T7
VDDCORE
Core power
Core power, 2.5V
T8
DRIVE[0]
2
High /
Low
I/O
PWM drive output
T9
FB[1]
I
PWM feedback input
T10
COL[5]
1
High
O
Keyboard scanner column drive
T11
VDDIO
Pad power
Digital I/O power, 3.3V
T12
BUZ
1
Low
O
Buzzer drive output
T13
D[28]
1
Low
I/O
Data I/O
T14
A[26]/DRA[1]
2
Low
O
System byte address / SDRAM address
T15
D[25]
1
Low
I/O
Data I/O
T16
VSSIO
Pad ground
I/O ground
Table 22. JTAG Boundary Scan Signal Ordering
LQFP
Pin No.
PBGA
Ball
Signal
Type
Position
1B1
nCS[5]
O
1
4
C2
EXPCLK
I/O
3
5E4
WORD
O
6
D1
WRITE/nSDRAS
O
8
7
F5
RUN/CLKEN
O
10
8
D2
EXPRDY
I
13
Table 21. 256-Ball PBGA Ball Listing (Continued)
Ball Location
Name
Strength
Reset
State
Type
Description
相關(guān)PDF資料 |
PDF描述 |
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| 201692-3 | CTR FASTERNER PLUG BLOCK,104P |
| 1-201692-1 | CONN PLUG 104 POS MINI M SERIES |
| EP7311-IR-90 | IC ARM720T MCU 90MHZ 204-TFBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| EP7312-CV-90 | 功能描述:IC ARM720T MCU 90MHZ 208-LQFP RoHS:否 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:EP7 標(biāo)準(zhǔn)包裝:1,500 系列:AVR® ATtiny 核心處理器:AVR 芯體尺寸:8-位 速度:16MHz 連通性:I²C，LIN，SPI，UART/USART，USI 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):16 程序存儲(chǔ)器容量:8KB（4K x 16） 程序存儲(chǔ)器類(lèi)型:閃存 EEPROM 大小:512 x 8 RAM 容量:512 x 8 電壓 - 電源 (Vcc/Vdd):2.7 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 11x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:20-SOIC（0.295"，7.50mm 寬） 包裝:帶卷 (TR) |
| EP7312-CV-C | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:HIGH-PERFORMANCE, LOW-POWER SYSTEM-ON-CHIP WITH SDRAM AND ENHANCED DIGITAL AUDIO INTERFACE |
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