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參數(shù)資料
| 型號(hào)： | EP7312-IVZ |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 11/54頁(yè) |
| 文件大小： | 0K |
| 描述： | IC ARM720T MCU 90/74MHZ 208-LQFP |
| 標(biāo)準(zhǔn)包裝： | 36 |
| 系列： | EP7 |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 32-位 |
| 速度： | 74MHz |
| 連通性： | 編解碼器，DAI，EBI/EMI，IrDA，鍵盤(pán)，SPI/Microwire1，UART/USART |
| 外圍設(shè)備： | LCD，LED，MaverickKey，PWM |
| 輸入/輸出數(shù)： | 27 |
| 程序存儲(chǔ)器類(lèi)型： | ROMless |
| RAM 容量： | 56K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.3 V ~ 2.7 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 208-LQFP |
| 包裝： | 托盤(pán) |
| 配用： | 598-1209-ND - KIT DEVELOPMENT EP73XX ARM7 |
| 其它名稱(chēng)： | 598-1135 |
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DS508F2
Copyright Cirrus Logic, Inc. 2011
(All Rights Reserved)
19
EP7312
High-Performance, Low-Power System on Chip
SDRAM Burst Write Cycle
Note:
1. Timings are shown with CAS latency = 2
2. The SDCLK signal may be phase shifted relative to the rest of the SDRAM control and data signals due to uneven loading.
Designers should take care to ensure that delays between SDRAM control and data signals are approximately equal
SDCLK
SDCS
SDRAS
SDCAS
SDQM
ADDR
DATA
SDMWE
0
D1
ADRAS
ADCAS
D4
D3
D2
t
CSa
t
RAa
t
CAa
t
CSa
t
CSd
t
RAd
t
CSd
t
CAd
t
ADv
t
DAd
t
ADv
t
DAd
t
DAd
t
DAd
t
MWa
t
MWd
Figure 5. SDRAM Burst Write Cycle Timing Measurement
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP7312-CVZ-90 | IC ARM720T MCU 90MHZ 208-LQFP |
| EP7312-CBZ | IC ARM720T MCU 74MHZ 256-PBGA |
| AT91SAM7SE256-CU | IC ARM7 MCU FLASH 256K 144-LFBGA |
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| ADUC847BCPZ62-3 | IC MCU FLASH 24BIT ADC 56LFCSP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP7312M-CBZ | 功能描述:音頻片上系統(tǒng) - SoC IC Hgh-Prfrmnc Low- Power SOC w/SDRAM RoHS:否 制造商:Cirrus Logic |
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