參數(shù)資料
型號(hào)： EPM3064ATI100-10N
廠商： Altera
文件頁(yè)數(shù)： 20/46頁(yè)
文件大?。?/td> 0K
描述： IC MAX 3000A CPLD 64 100-TQFP
產(chǎn)品變化通告： Bond Wire Change 4/Sept/2008
標(biāo)準(zhǔn)包裝： 270
系列： MAX® 3000A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 4
宏單元數(shù)： 64
門數(shù)： 1250
輸入/輸出數(shù)： 66
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 603 (CN2011-ZH PDF)
其它名稱： 544-2278
Altera Corporation
27
MAX 3000A Programmable Logic Device Family Data Sheet
Figure 11. MAX 3000A Switching Waveforms
Combinatorial Mode
Input Pin
I/O Pin
PIA Delay
Shared Expander
Delay
Logic Array
Input
Parallel Expander
Delay
Logic Array
Output
Output Pin
tIN
tLAC , tLAD
tPIA
tOD
tPEXP
tIO
tSEXP
tCOMB
Global Clock Mode
Global
Clock Pin
Global Clock
at Register
Data or Enable
(Logic Array Output)
tF
tCH
tCL
tR
tIN
tGLOB
tSU
tH
Array Clock Mode
Input or I/O Pin
Clock into PIA
Clock into
Logic Array
Clock at
Register
Data from
Logic Array
Register to PIA
to Logic Array
Register Output
to Pin
tF
tR
tACH
tACL
tSU
tIN
tIO
tRD
tPIA
tCLR , tPRE
tH
tPIA
tIC
tPIA
tOD
tR & tF < 2 ns. Inputs are
driven at 3 V for a logic
high and 0 V for a logic
low. All timing
characteristics are
measured at 1.5 V.
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PDF描述
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