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參數資料
| 型號： | EPM7032AETC44-7 |
| 廠商： | Altera |
| 文件頁數： | 5/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 32 44-TQFP |
| 產品變化通告： | Bond Wire Change 4/Sept/2008 |
| 標準包裝： | 480 |
| 系列： | MAX® 7000A |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 7.5ns |
| 電壓電源 - 內部： | 3 V ~ 3.6 V |
| 邏輯元件/邏輯塊數目： | 2 |
| 宏單元數： | 32 |
| 門數： | 600 |
| 輸入/輸出數： | 36 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-TQFP |
| 供應商設備封裝： | 44-TQFP（10x10） |
| 包裝： | 托盤 |
| 產品目錄頁面： | 604 (CN2011-ZH PDF) |
| 其它名稱： | 544-1180 |
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Altera Corporation
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MAX 7000A Programmable Logic Device Data Sheet
Figure 5. MAX 7000A PIA Routing
While the routing delays of channel-based routing schemes in masked or
FPGAs are cumulative, variable, and path-dependent, the MAX 7000A
PIA has a predictable delay. The PIA makes a design’s timing
performance easy to predict.
I/O Control Blocks
The I/O control block allows each I/O pin to be individually configured
for input, output, or bidirectional operation. All I/O pins have a tri-state
buffer that is individually controlled by one of the global output enable
control block for MAX 7000A devices. The I/O control block has 6 or
10 global output enable signals that are driven by the true or complement
of two output enable signals, a subset of the I/O pins, or a subset of the
I/O macrocells.
To LAB
PIA Signals
相關PDF資料 |
PDF描述 |
|---|---|
| R-78B6.5-1.0 | CONV DC/DC 1A 6.5V OUT SIP VERT |
| EPM3064ATI44-10 | IC MAX 3000A CPLD 64 44-TQFP |
| GRM31MR72A473KA01L | CAP CER 0.047UF 100V X7R 1206 |
| CDR7D28MNNP-2R0NC | INDUCTOR 2.0UH 4.3A SHIELDED |
| TPSD477K004R0045 | CAP TANT 470UF 4V 10% 2917 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EPM7032AETC447N | 制造商:Altera Corporation 功能描述: |
| EPM7032AETC44-7N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 32 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7032AETI100-7 | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:High-performance 3.3-V EEPROM-based programmable logic devices (PLDs) built on second-generation Multiple Array MatriX |
| EPM7032AETI44-5 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Electrically-Erasable Complex PLD |
| EPM7032AETI44-7 | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 32 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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