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參數(shù)資料
| 型號： | EPM7128SLC84-15N |
| 廠商： | Altera |
| 文件頁數(shù)： | 25/66頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 128 84-PLCC |
| 標(biāo)準(zhǔn)包裝： | 75 |
| 系列： | MAX® 7000 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時間 tpd(1)： | 15.0ns |
| 電壓電源 - 內(nèi)部： | 4.75 V ~ 5.25 V |
| 邏輯元件/邏輯塊數(shù)目： | 8 |
| 宏單元數(shù)： | 128 |
| 門數(shù)： | 2500 |
| 輸入/輸出數(shù)： | 68 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 84-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 84-PLCC（29.31x29.31） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 604 (CN2011-ZH PDF) |
| 其它名稱： | 544-2034 EPM7128SLC84-15N-ND |
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Altera Corporation
31
MAX 7000 Programmable Logic Device Family Data Sheet
operating conditions.
Table 19. MAX 7000 & MAX 7000E External Timing Parameters
Symbol
Parameter
Conditions
-6 Speed Grade
-7 Speed Grade
Unit
Min
Max
Min
Max
tPD1
Input to non-registered output
C1 = 35 pF
6.0
7.5
ns
tPD2
I/O input to non-registered output
C1 = 35 pF
6.0
7.5
ns
tSU
Global clock setup time
5.0
6.0
ns
tH
Global clock hold time
0.0
ns
tFSU
Global clock setup time of fast input
2.5
3.0
ns
tFH
Global clock hold time of fast input
0.5
ns
tCO1
Global clock to output delay
C1 = 35 pF
4.0
4.5
ns
tCH
Global clock high time
2.5
3.0
ns
tCL
Global clock low time
2.5
3.0
ns
tASU
Array clock setup time
2.5
3.0
ns
tAH
Array clock hold time
2.0
ns
tACO1
Array clock to output delay
C1 = 35 pF
6.5
7.5
ns
tACH
Array clock high time
3.0
ns
tACL
Array clock low time
3.0
ns
tCPPW
Minimum pulse width for clear and
preset
3.0
ns
tODH
Output data hold time after clock
C1 = 35 pF (4)
1.0
ns
tCNT
Minimum global clock period
6.6
8.0
ns
fCNT
Maximum internal global clock
frequency
151.5
125.0
MHz
tACNT
Minimum array clock period
6.6
8.0
ns
fACNT
Maximum internal array clock
frequency
151.5
125.0
MHz
fMAX
Maximum clock frequency
200
166.7
MHz
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PDF描述 |
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參數(shù)描述 |
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| EPM7128SLC846F | 制造商:ALTERA 功能描述:* |
| EPM7128SLC84-6F | 功能描述:IC MAX 7000 CPLD 128 84-PLCC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - CPLD（復(fù)雜可編程邏輯器件） 系列:MAX® 7000 標(biāo)準(zhǔn)包裝:24 系列:CoolRunner II 可編程類型:系統(tǒng)內(nèi)可編程 最大延遲時間 tpd(1):7.1ns 電壓電源 - 內(nèi)部:1.7 V ~ 1.9 V 邏輯元件/邏輯塊數(shù)目:24 宏單元數(shù):384 門數(shù):9000 輸入/輸出數(shù):173 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:208-BFQFP 供應(yīng)商設(shè)備封裝:208-PQFP（28x28） 包裝:托盤 |
| EPM7128SLC84-6N | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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