參數(shù)資料
型號(hào): EPM7128SQC100-10N
廠商: Altera
文件頁(yè)數(shù): 66/66頁(yè)
文件大?。?/td> 0K
描述: IC MAX 7000 CPLD 128 100-PQFP
標(biāo)準(zhǔn)包裝: 66
系列: MAX® 7000
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 10.0ns
電壓電源 - 內(nèi)部: 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目: 8
宏單元數(shù): 128
門數(shù): 2500
輸入/輸出數(shù): 84
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 100-BQFP
供應(yīng)商設(shè)備封裝: 100-PQFP(14x20)
包裝: 托盤
產(chǎn)品目錄頁(yè)面: 604 (CN2011-ZH PDF)
其它名稱: 544-2037
EPM7128SQC100-10N-ND
Altera Corporation
9
MAX 7000 Programmable Logic Device Family Data Sheet
Each LAB is fed by the following signals:
36 signals from the PIA that are used for general logic inputs
Global controls that are used for secondary register functions
Direct input paths from I/O pins to the registers that are used
for fast setup times for MAX 7000E and MAX 7000S devices
Macrocells
The MAX 7000 macrocell can be individually configured for either
sequential or combinatorial logic operation. The macrocell consists
of three functional blocks: the logic array, the product-term select
matrix, and the programmable register. The macrocell of EPM7032,
EPM7064, and EPM7096 devices is shown in Figure 3.
Figure 3. EPM7032, EPM7064 & EPM7096 Device Macrocell
Product-
Ter
T
T m
Select
Matrix
36 Signals
from PIA
16 Expander
Product Ter
T
T ms
Logic Array
Parallel Logic
Expanders
(from other
macrocells)
Shared Logic
Expanders
Clear
Select
Global
Clear
Global
Clocks
Clock/
Enable
Select
2
PRN
CLRN
D/T
Q
ENA
Register
Bypass
To I/O
Control
Block
to PIA
Programmable
Register
From
I/O pin
Fast Input
Select
VCC
相關(guān)PDF資料
PDF描述
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參數(shù)描述
EPM7128SQC10015 制造商:Altera Corporation 功能描述:MAX ISP PLD 7128 PQFP100 3.3V
EPM7128SQC100-15 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 84 IOs RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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