參數(shù)資料
型號: EPM7256SQC208-15N
廠商: Altera
文件頁數(shù): 1/66頁
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描述: IC MAX 7000 CPLD 256 208-PQFP
標(biāo)準(zhǔn)包裝: 48
系列: MAX® 7000
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1): 15.0ns
電壓電源 - 內(nèi)部: 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目: 16
宏單元數(shù): 256
門數(shù): 5000
輸入/輸出數(shù): 164
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 208-BFQFP
供應(yīng)商設(shè)備封裝: 208-PQFP(28x28)
包裝: 托盤
產(chǎn)品目錄頁面: 604 (CN2011-ZH PDF)
其它名稱: 544-2064
EPM7256SQC208-15N-ND
Altera Corporation
1
MAX 7000
Programmable Logic
Device Family
September 2005, ver. 6.7
Data Sheet
DS-MAX7000-6.7
Features...
High-performance, EEPROM-based programmable logic devices
(PLDs) based on second-generation MAX architecture
5.0-V in-system programmability (ISP) through the built-in
IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface available in
MAX 7000S devices
ISP circuitry compatible with IEEE Std. 1532
Includes 5.0-V MAX 7000 devices and 5.0-V ISP-based MAX 7000S
devices
Built-in JTAG boundary-scan test (BST) circuitry in MAX 7000S
devices with 128 or more macrocells
Complete EPLD family with logic densities ranging from 600 to
5,000 usable gates (see Tables 1 and 2)
5-ns pin-to-pin logic delays with up to 175.4-MHz counter
frequencies (including interconnect)
PCI-compliant devices available
f For information on in-system programmable 3.3-V MAX 7000A or 2.5-V
Table 1. MAX 7000 Device Features
Feature
EPM7032
EPM7064
EPM7096
EPM7128E
EPM7160E
EPM7192E
EPM7256E
Usable
gates
600
1,250
1,800
2,500
3,200
3,750
5,000
Macrocells
32
64
96
128
160
192
256
Logic array
blocks
246
8
10
12
16
Maximum
user I/O pins
36
68
76
100
104
124
164
tPD (ns)
6
7.5
10
12
tSU (ns)
5
6677
7
tFSU (ns)
2.5
3333
3
tCO1 (ns)
4
4.5
5
6
fCNT (MHz)
151.5
125.0
100.0
90.9
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PDF描述
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參數(shù)描述
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EPM7256SQC208-7 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 256 Macro 164 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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