參數(shù)資料
型號(hào): EPM7256SQC208-7
廠商: Altera
文件頁數(shù): 64/66頁
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描述: IC MAX 7000 CPLD 256 208-PQFP
標(biāo)準(zhǔn)包裝: 48
系列: MAX® 7000
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 7.5ns
電壓電源 - 內(nèi)部: 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目: 16
宏單元數(shù): 256
門數(shù): 5000
輸入/輸出數(shù): 164
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 208-BFQFP
供應(yīng)商設(shè)備封裝: 208-PQFP(28x28)
包裝: 托盤
產(chǎn)品目錄頁面: 604 (CN2011-ZH PDF)
其它名稱: 544-2065
EPM7256SQC208-7-ND
Altera Corporation
7
MAX 7000 Programmable Logic Device Family Data Sheet
The MAX 7000 architecture includes four dedicated inputs that can
be used as general-purpose inputs or as high-speed, global control
signals (clock, clear, and two output enable signals) for each
macrocell and I/O pin. Figure 1 shows the architecture of EPM7032,
EPM7064, and EPM7096 devices.
Figure 1. EPM7032, EPM7064 & EPM7096 Device Block Diagram
I/O
Control
Block
8 to 16
I/O pins
8 to 16
16
36
I/O
Control
Block
8 to 16
I/O pins
36
8 to 16
16
8 to 16
I/O pins
36
8 to 16
16
I/O
Control
Block
I/O
Control
Block
8 to 16
I/O pins
8 to 16
16
36
LAB A
LAB B
LAB C
Macrocells
33 to 48
LAB D
INPUT/GCLRn
INPUT/OE1
INPUT/OE2
Macrocells
17 to 32
Macrocells
49 to 64
PIA
INPUT/GLCK1
Macrocells
1 to 16
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PDF描述
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參數(shù)描述
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