參數(shù)資料
型號： EPM7512AEQI208-10N
廠商： Altera
文件頁數(shù)： 12/64頁
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描述： IC MAX 7000 CPLD 512 208-PQFP
標準包裝： 72
系列： MAX® 7000A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 32
宏單元數(shù)： 512
門數(shù)： 10000
輸入/輸出數(shù)： 176
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP
供應商設備封裝： 208-PQFP（28x28）
包裝： 托盤
2
Altera Corporation
MAX 7000A Programmable Logic Device Data Sheet
...and More
Features
■
4.5-ns pin-to-pin logic delays with counter frequencies of up to
227.3 MHz
■
MultiVoltTM I/O interface enables device core to run at 3.3 V, while
I/O pins are compatible with 5.0-V, 3.3-V, and 2.5-V logic levels
■
Pin counts ranging from 44 to 256 in a variety of thin quad flat pack
(TQFP), plastic quad flat pack (PQFP), ball-grid array (BGA), space-
saving FineLine BGATM, and plastic J-lead chip carrier (PLCC)
packages
■
Supports hot-socketing in MAX 7000AE devices
■
Programmable interconnect array (PIA) continuous routing structure
for fast, predictable performance
■
PCI-compatible
■
Bus-friendly architecture, including programmable slew-rate control
■
Open-drain output option
■
Programmable macrocell registers with individual clear, preset,
clock, and clock enable controls
■
Programmable power-up states for macrocell registers in
MAX 7000AE devices
■
Programmable power-saving mode for 50% or greater power
reduction in each macrocell
■
Configurable expander product-term distribution, allowing up to
32 product terms per macrocell
■
Programmable security bit for protection of proprietary designs
■
6 to 10 pin- or logic-driven output enable signals
■
Two global clock signals with optional inversion
■
Enhanced interconnect resources for improved routability
■
Fast input setup times provided by a dedicated path from I/O pin to
macrocell registers
■
Programmable output slew-rate control
■
Programmable ground pins
Table 1. MAX 7000A Device Features
Feature
EPM7032AE
EPM7064AE
EPM7128AE
EPM7256AE
EPM7512AE
Usable gates
600
1,250
2,500
5,000
10,000
Macrocells
32
64
128
256
512
Logic array blocks
2
4
8
16
32
Maximum user I/O
pins
36
68
100
164
212
tPD (ns)
4.5
5.0
5.5
7.5
tSU (ns)
2.9
2.8
3.3
3.9
5.6
tFSU (ns)
2.5
3.0
tCO1 (ns)
3.0
3.1
3.4
3.5
4.7
fCNT (MHz)
227.3
222.2
192.3
172.4
116.3
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EPM7512AETC144-12 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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