參數(shù)資料
型號： EPM7512BBC256-10
廠商： Altera
文件頁數(shù)： 49/66頁
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 512 256-BGA
標準包裝： 120
系列： MAX® 7000B
可編程類型： 系統(tǒng)內可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內部： 2.375 V ~ 2.625 V
邏輯元件/邏輯塊數(shù)目： 32
宏單元數(shù)： 512
門數(shù)： 10000
輸入/輸出數(shù)： 212
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA
供應商設備封裝： 256-BGA（27x27）
包裝： 托盤
Altera Corporation
53
MAX 7000B Programmable Logic Device Data Sheet
Table 32. EPM7512B Selectable I/O Standard Timing Adder Delays (Part 1 of 2)
I/O Standard
Parameter
Speed Grade
Unit
-5
-7
-10
Min
Max
Min
Max
Min
Max
3.3 V TTL/CMOS
Input to PIA
0.0
ns
Input to global clock and clear
0.0
ns
Input to fast input register
0.0
ns
All outputs
0.0
ns
2.5 V TTL/CMOS
Input to PIA
0.4
0.5
0.7
ns
Input to global clock and clear
0.3
0.4
0.5
ns
Input to fast input register
0.2
0.3
ns
All outputs
0.2
0.3
ns
1.8 V TTL/CMOS
Input to PIA
0.7
1.0
1.3
ns
Input to global clock and clear
0.6
0.8
1.0
ns
Input to fast input register
0.5
0.6
0.8
ns
All outputs
1.3
1.8
2.3
ns
SSTL-2 Class I
Input to PIA
1.5
2.0
2.7
ns
Input to global clock and clear
1.4
1.9
2.5
ns
Input to fast input register
1.1
1.5
2.0
ns
All outputs
0.0
ns
SSTL-2 Class II
Input to PIA
1.5
2.0
2.7
ns
Input to global clock and clear
1.4
1.9
2.5
ns
Input to fast input register
1.1
1.5
2.0
ns
All outputs
–0.1
–0.2
ns
SSTL-3 Class I
Input to PIA
1.4
1.9
2.5
ns
Input to global clock and clear
1.2
1.6
2.2
ns
Input to fast input register
1.0
1.4
1.8
ns
All outputs
0.0
ns
SSTL-3 Class II
Input to PIA
1.4
1.9
2.5
ns
Input to global clock and clear
1.2
1.6
2.2
ns
Input to fast input register
1.0
1.4
1.8
ns
All outputs
0.0
ns
GTL+
Input to PIA
1.8
2.5
3.3
ns
Input to global clock and clear
1.9
2.6
3.5
ns
Input to fast input register
1.8
2.5
3.3
ns
All outputs
0.0
ns
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