參數(shù)資料
型號(hào)： EPM7512BFC256-7N
廠商： Altera
文件頁(yè)數(shù)： 36/66頁(yè)
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 512 256-FBGA
標(biāo)準(zhǔn)包裝： 90
系列： MAX® 7000B
可編程類(lèi)型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 7.5ns
電壓電源 - 內(nèi)部： 2.375 V ~ 2.625 V
邏輯元件/邏輯塊數(shù)目： 32
宏單元數(shù)： 512
門(mén)數(shù)： 10000
輸入/輸出數(shù)： 212
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FBGA（17x17）
包裝： 托盤(pán)
Altera Corporation
41
MAX 7000B Programmable Logic Device Data Sheet
Table 23. EPM7064B Selectable I/O Standard Timing Adder Delays (Part 1 of 2)
I/O Standard
Parameter
Speed Grade
Unit
-3
-5
-7
Min
Max
Min
Max
Min
Max
3.3 V TTL/CMOS
Input to PIA
0.0
ns
Input to global clock and clear
0.0
ns
Input to fast input register
0.0
ns
All outputs
0.0
ns
2.5 V TTL/CMOS
Input to PIA
0.3
0.4
0.6
ns
Input to global clock and clear
0.3
0.4
0.6
ns
Input to fast input register
0.2
0.3
0.4
ns
All outputs
0.2
0.3
0.4
ns
1.8 V TTL/CMOS
Input to PIA
0.5
0.7
1.1
ns
Input to global clock and clear
0.5
0.7
1.1
ns
Input to fast input register
0.4
0.6
0.9
ns
All outputs
1.2
1.7
2.6
ns
SSTL-2 Class I
Input to PIA
1.3
1.9
2.8
ns
Input to global clock and clear
1.2
1.7
2.6
ns
Input to fast input register
0.9
1.3
1.9
ns
All outputs
0.0
ns
SSTL-2 Class II
Input to PIA
1.3
1.9
2.8
ns
Input to global clock and clear
1.2
1.7
2.6
ns
Input to fast input register
0.9
1.3
1.9
ns
All outputs
–0.1
–0.2
ns
SSTL-3 Class I
Input to PIA
1.2
1.7
2.6
ns
Input to global clock and clear
0.9
1.3
1.9
ns
Input to fast input register
0.8
1.1
1.7
ns
All outputs
0.0
ns
SSTL-3 Class II
Input to PIA
1.2
1.7
2.6
ns
Input to global clock and clear
0.9
1.3
1.9
ns
Input to fast input register
0.8
1.1
1.7
ns
All outputs
0.0
ns
GTL+
Input to PIA
1.6
2.3
3.4
ns
Input to global clock and clear
1.6
2.3
3.4
ns
Input to fast input register
1.5
2.1
3.2
ns
All outputs
0.0
ns
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