1-4 Revision 10 Table 1-1 describes the possible connections of the routed clock networks, CLKA and CLKB." />
參數(shù)資料
型號： EX128-TQG100
廠商： Microsemi SoC
文件頁數(shù)： 47/48頁
文件大?。?/td> 0K
描述： IC FPGA ANTIFUSE 6K 100-TQFP
標準包裝： 90
系列： EX
邏輯元件/單元數(shù)： 256
輸入/輸出數(shù)： 70
門數(shù)： 6000
電源電壓： 2.3 V ~ 2.7 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 100-LQFP
供應商設備封裝： 100-TQFP（14x14）
eX FPGA Architecture and Characteristics
1-4
Revision 10
Table 1-1 describes the possible connections of the routed clock networks, CLKA and CLKB.
Unused clock pins must not be left floating and must be tied to HIGH or LOW.
Figure 1-5 eX HCLK Clock Pad
Figure 1-6 eX Routed Clock Buffer
Table 1-1 Connections of Routed Clock Networks, CLKA and CLKB
Module
Pins
C-Cell
A0, A1, B0 and B1
R-Cell
CLKA, CLKB, S0, S1, PSET, and CLR
I/O-Cell
EN
Constant Load
Clock Network
HCLKBUF
Clock Network
From Internal Logic
CLKBUF
CLKBUFI
CLKINT
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PDF描述
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參數(shù)描述
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