參數(shù)資料
型號(hào)： EZ80L92AZ050SC
元件分類： 微處理器
英文描述： Microprocessor
中文描述： 微處理器
文件頁(yè)數(shù)： 223/237頁(yè)
文件大?。?/td> 2591K
代理商： EZ80L92AZ050SC
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eZ80L92
eZ80 Webserver-i Product Specification
PS013004-1002
PRELIMINARY
Watch-Dog Timer
74
Watch-Dog Timer Reset Register
The Watch-Dog Timer Reset register, detailed in Table 28, is an 8-bit Write-Only
register. The Watch-Dog Timer is reset when an A5h value followed by 5Ah is writ-
ten to this register. Any amount of time can occur between the writing of the A5h
value and the 5Ah value, so long as the WDT time-out does not occur prior to
completion.
[1:0]
WDT_PERIOD
00
WDT time-out period is 227 clock cycles.
01
WDT time-out period is 225 clock cycles.
10
WDT time-out period is 222 clock cycles.
11
WDT time-out period is 218 clock cycles.
Table 28. Watch-Dog Timer Reset Register (WDT_RR = 0094h)
Bit
76543210
Reset
XXXXXXXX
CPU Access
WWWWWWWW
Note: X = Undefined; W = Write only.
Bit
Position
Value
Description
[7:0]
WDT_RR
A5h
The first WRITE value required to reset the WDT prior to a
time-out.
5Ah
The second WRITE value required to reset the WDT prior to a
time-out. If an A5h, 5Ah sequence is written to WDT_RR, the
WDT timer is reset to its initial count value, and counting
resumes.
Bit
Position
Value
Description
Note: *RST_FLAG is only cleared by a non-WDT RESET.
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PDF描述
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FAM-50X1S-T80 FIBER OPTIC TRANSCEIVER, TRANSPONDER, 1530-1565nm, 10331.1Mbps(Tx), 10331.1Mbps(Rx), PANEL MOUNT, SC CONNECTOR
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參數(shù)描述
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EZ81 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:DOUBLE ANODE RECTIFYING TUBE
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