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參數(shù)資料
| 型號(hào)： | GMS36112T |
| 廠(chǎng)商： | Hynix Semiconductor Inc. |
| 英文描述： | 4-BIT SINGLE CHIP MICROCOMPUTERS |
| 中文描述： | 4位單片機(jī)微機(jī) |
| 文件頁(yè)數(shù)： | 41/109頁(yè) |
| 文件大?。?/td> | 813K |
| 代理商： | GMS36112T |
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4-8
Reset Operation
GMS36/37XXX has three reset sources. One is a built-in Power-on reset circuit, another
is a built-in Low VDD Detection circuit, the other is the overflow of Watch Dog Timer. (WDT)
All reset operations are internal in the GMS36/37XXX.
Built-in Power On Reset Circuit
GMS36/37XXX has a built-in Power-on reset circuit consisting of an about 1
D
Resistor
and a 3pF Capacitor. When the Power-on reset pulse occurs, system reset signal is
latched and WDT is cleared. After the overflow time of WDT (2
13
x System clock time)
system reset signal is released.
t
reset
VCC
System
RESETB
About 108msec at
fosc = 455kHz
9''
*1'
&RXQWHU
:'7
6\VWHP
5(6(7%
D
S)
<GMS36/37XXX>
Fig. 4-4 Power-On Reset Circuit and Timing Chart
Chapter 4. FUNCTIONAL DESCRIPTION
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