MC68HC908AT32
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Rev. 2.0
General Release Specification
MOTOROLA
Byte Data Link Controller–Digital (BDLC–D)
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517
L
G
R
General Release Specification — MC68HC908AT32
Section 28. Byte Data Link Controller–Digital (BDLC–D)
28.1 Contents
20.2
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .519
20.3
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .519
20.4
20.4.1
20.4.1.1
20.4.1.2
20.4.1.3
20.4.1.4
20.4.1.5
20.4.1.6
20.4.1.7
Functional Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .520
BDLC Operating Modes . . . . . . . . . . . . . . . . . . . . . . . . . .522
Power Off Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .522
Reset Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .523
Run Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .523
BDLC Wait Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .523
BDLC Stop Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .524
Digital Loopback Mode. . . . . . . . . . . . . . . . . . . . . . . . . .524
Analog Loopback Mode . . . . . . . . . . . . . . . . . . . . . . . . .524
20.5
20.5.1
20.5.1.1
20.5.1.2
20.5.2
20.5.3
20.5.4
20.5.5
BDLC MUX Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .525
Rx Digital Filter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .526
Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .526
Performance. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .527
J1850 Frame Format. . . . . . . . . . . . . . . . . . . . . . . . . . . . .528
J1850 VPW Symbols. . . . . . . . . . . . . . . . . . . . . . . . . . . . .531
J1850 VPW Valid/Invalid Bits and Symbols . . . . . . . . . . .534
Message Arbitration . . . . . . . . . . . . . . . . . . . . . . . . . . . . .538
20.6
20.6.1
20.6.2
20.6.3
20.6.4
20.6.5
20.6.5.1
20.6.5.2
20.6.5.3
BDLC Protocol Handler . . . . . . . . . . . . . . . . . . . . . . . . . . . . .540
Protocol Architecture. . . . . . . . . . . . . . . . . . . . . . . . . . . . .541
Rx and Tx Shift Registers . . . . . . . . . . . . . . . . . . . . . . . . .541
Rx and Tx Shadow Registers . . . . . . . . . . . . . . . . . . . . . .542
Digital Loopback Multiplexer . . . . . . . . . . . . . . . . . . . . . . .542
State Machine . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .542
4X Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .542
Receiving a Message in Block Mode. . . . . . . . . . . . . . .543
Transmitting a Message in Block Mode. . . . . . . . . . . . .543
F
Freescale Semiconductor, Inc.
n
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