參數(shù)資料
型號(hào)： HD6417615AF60
廠商： Hitachi,Ltd.
英文描述： CMOS single-chip microcontroller
中文描述： CMOS單芯片微控制器
文件頁(yè)數(shù)： 10/873頁(yè)
文件大?。?/td> 2741K
代理商： HD6417615AF60
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vi
7.6.6
7.6.7
7.6.8
7.6.9
Burst ROM Interface.......................................................................................................... 335
Idles between Cycles.......................................................................................................... 339
Bus Arbitration................................................................................................................... 340
7.9.1
Master Mode......................................................................................................... 345
7.10 Additional Items................................................................................................................. 346
7.10.1 Resets.................................................................................................................... 346
7.10.2 Access as Viewed from CPU, DMAC or E-DMAC............................................. 346
7.10.3 STATS1 and STATS0 Pins.................................................................................. 348
7.10.4
BUSHiZ
Specification.......................................................................................... 348
7.11 Usage Notes ....................................................................................................................... 349
7.11.1 Normal Space Access after Synchronous DRAM Write when Using DMAC..... 349
7.11.2 When Using I
φ
: E
φ
Clock Ratio of 1 : 1, 8-Bit Bus Width,
and External Wait Input........................................................................................ 351
EDO Mode............................................................................................................ 328
DRAM Single Transfer......................................................................................... 332
Refreshing............................................................................................................. 333
Power-On Sequence.............................................................................................. 335
7.7
7.8
7.9
Section 8
8.1
Cache
.................................................................................................................. 353
Introduction........................................................................................................................ 353
8.1.1
Register Configuration.......................................................................................... 354
Register Description........................................................................................................... 354
8.2.1
Cache Control Register (CCR)............................................................................. 354
Address Space and the Cache............................................................................................ 356
Cache Operation................................................................................................................. 357
8.4.1
Cache Reads.......................................................................................................... 357
8.4.2
Write Access......................................................................................................... 359
8.4.3
Cache-Through Access......................................................................................... 362
8.4.4
The TAS Instruction ............................................................................................. 362
8.4.5
Pseudo-LRU and Cache Replacement.................................................................. 362
8.4.6
Cache Initialization............................................................................................... 364
8.4.7
Associative Purges................................................................................................ 364
8.4.8
Cache Flushing...................................................................................................... 365
8.4.9
Data Array Access................................................................................................ 365
8.4.10 Address Array Access........................................................................................... 366
Cache Use.......................................................................................................................... 367
8.5.1
Initialization.......................................................................................................... 367
8.5.2
Purge of Specific Lines......................................................................................... 368
8.5.3
Cache Data Coherency.......................................................................................... 368
8.5.4
Two-Way Cache Mode......................................................................................... 369
Usage Notes ....................................................................................................................... 370
8.6.1
Standby ................................................................................................................. 370
8.6.2
Cache Control Register......................................................................................... 370
8.2
8.3
8.4
8.5
8.6
相關(guān)PDF資料
PDF描述
HD6417615 CMOS single-chip microcontroller
HD64180R1P6 HIGH INTEGRATION CMOS MICROCONTROLLERS
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參數(shù)描述
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HD6417615ARFV 功能描述:IC SUPERH MCU ROMLESS 208LQFP RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:SuperH® SH 以太網(wǎng)型 標(biāo)準(zhǔn)包裝:250 系列:56F8xxx 核心處理器:56800E 芯體尺寸:16-位 速度:60MHz 連通性:CAN，SCI，SPI 外圍設(shè)備:POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):21 程序存儲(chǔ)器容量:40KB（20K x 16） 程序存儲(chǔ)器類(lèi)型:閃存 EEPROM 大小:- RAM 容量:6K x 16 電壓 - 電源 (Vcc/Vdd):2.25 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 6x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:48-LQFP 包裝:托盤(pán) 配用:MC56F8323EVME-ND - BOARD EVALUATION MC56F8323
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